verilog高手看看我的reg变量判断为啥第二种写法编译报错呢？
2021-5-10 15:20
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好久没来了，，，，，今天来看看
想明白了，，直接看RTL图就全部明白了
1、第一次时不满足条件条件，所以没有清0，第二次满足了条件，故清 ...
谢谢，能帮我回答下9楼的问题吗
谢谢，能帮我回答下9楼的问题吗
嗯，我的第一种和他的写法的效果是一样的，刚才仿真了，波形和rtl图都一样，但是我的那个写法不建议写， ...
always中的语句不都是顺序执行的吗？
verilog刚学，，不太明白，报错的提示也不理解，谢谢先
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