xilinx、Altera只有学校用得多，真正的产品上很少看到
2013-1-23 22:03
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:)
在SPARTAN3E-XC3S250学习板上生成PWM波输出电压问题
2013-1-19 22:37
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嗯，我换成其他差分引脚解决了！然后BANK1上的P61，P63输出ah,al（P60，P62空着），也正常了！这个是什么原 ...
P_coparator: process(clk)
begin
if rising_edge(clk) then
if phase_wide_buf>=ref_cnt then
puls ...
申请开设【仿真与验证】版
2020-7-13 08:34
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牛人的FPGA设计经验分享
2016-9-11 22:43
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要过年了，累了，烦了，想换工作
2013-2-1 18:47
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请教几个IP核的问题
2013-1-23 15:03
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VHDL中integer的综合问题
2013-1-17 20:36
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NIOSII好用不？
2013-1-15 22:55
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vhdl中调用IP核以后的配置怎么写
2013-1-13 21:56
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FPGA工作频率
2013-1-16 23:16
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