求助：两根线AC电源输入的设备内“地”在哪里？
2009-2-27 21:27
- 模拟技术论坛
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在什么情况下，这些地共地呢？
谢谢，解答了第二个问题。电源变换我没做过，是不是如图红色标的那样：那点就是直流电源地，也就是整个电子 ...
急：立式RJ45座的管脚定义！
2009-2-28 15:55
- 模拟技术论坛
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用在哪跟pin号有关系吗？付加线序定义：1 TX+ Tranceive Data+ (发信号+) 2 ...
圈圈版主：关于您的"FFT物里意义"这篇还有一个问题
2009-3-31 14:53
- 电子技术交流论坛
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和前半部分组成的信号FFT变换后的频谱相同吗
请教圈圈：频率分辨率的问题
2009-4-2 10:29
- 电子技术交流论坛
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原信号含有频率为50.5Hz、相位为-30度、幅度为3V的交流信号,那么FFT后频谱情况？ ...
后面指的是什么后面？实际采到1024个点，再补上1024个0，看成2048个点参与fft变换？ ...
比如说采了2046个数，前1023和后1023完全相同，还能说：分辨率就是这个时间的倒数吗？ ...
关于芯片的DDR控制接口的一个问题
2009-3-6 17:41
- 嵌入式操作系统论坛
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......
急：立式RJ45座的管脚定义！
2009-2-27 17:21
- PCB技术
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马上就要投版，急啊
上面的立式图也是top view
华为_FPGA设计高级技巧Xilinx篇
2011-4-26 09:34
- FPGA论坛
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嗯，华为的东西就是好，至少是在我初学时见过的最好资料。
不过这个已经很老了，还v2呢，谁有最新的吗？ ...
FPGA时序收敛设计技巧(转)
2011-5-17 23:46
- FPGA论坛
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SuperX-man， 这篇**难道你不知道出处吗？
这就是《Xilinx通讯》这本杂志某期里面的一篇**，好像是37 or 36 ...
Xilinx常见问题回答
2011-4-13 21:51
- FPGA论坛
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Too Old
问几个问题
2011-4-17 16:52
- FPGA论坛
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microblaze
实用价值怎么说呢，一般场合还可以，跟特定功能asic(dsp/arm)等相比还是有差距。
但现在稍微高 ...
route delay很大的design,ISE如何约束更容易meet timing
2011-6-21 10:16
- FPGA论坛
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(15.1% logic, 84.9% route)
没用过Plan Ahead，如果是我，用FPGA Edtior优先先布这个关键路径。
难道PA特 ...
写testbench的问题
2011-7-27 11:37
- FPGA论坛
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我还交熟，可以帮你
请贴出设计源码
关于时序分析中时钟的设置。
2011-4-29 11:22
- FPGA论坛
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老大您这个是quartus界面吧。发错版了。
既然使用了PLL，应该只要设置20MHz的输入时钟
衍生时钟工具会帮助 ...
有人用过ICX274吗？
2011-4-26 20:49
- 电子技术交流论坛
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nod
有什么办法（手册里是没有的）提高帧率
请斑竹勿删，真不知该发到哪个版
LUT4如何实现一个16位的SRL
2013-1-24 09:07
- FPGA论坛
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打非所问。
这个大家都懂的，lut实现组合逻辑。
我的问题是如何实现一个16位的SRL
最好有图解。 ...
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