求助：关于这个CPLD片子的输出信号问题。
2015-1-4 09:22
- FPGA论坛
- 9
- 1825
玄德兄正解！
下午在实验室换了个500MHZ示波器看了一下， 示波器设置50ms或者100ms看CPLD输出信号还是幅 ...
自己顶，期待高人来解答！
自己顶！
大家新年快乐！
上面图片是用的200ms档位，后来用100μs或500μs能抓到的脉冲比较少，
输出每个脉冲周期宽度1.75μs确实 ...
自己顶！
最近在做光电编码器计数的设计，用lattice 的CPLD芯片ispLSI1016E，但是用示波器查看输出信号波形时，发现 ...
MAX485的输出电流：datasheet中的一个细节问题
2014-12-3 14:47
- 通信技术
- 12
- 2825
如何搭建一个电路将0.7--3.3V的电压转成0.1--0.9V
2014-12-1 12:40
- 模拟技术论坛
- 20
- 2733
lattice CPLD芯片开发过程中的时钟问题
2014-6-27 15:07
- FPGA论坛
- 2
- 1462
求助CPLD选型，用于光电编码器信号处理
2014-4-7 22:09
- FPGA论坛
- 13
- 2193
2
3
近期访客