MUX应用
2012-5-30 22:19
- FPGA论坛
- 4
- 1871
1. 在FPGA里要实现两种并串转换，但只对应一组输出
比如输入分别是20和30位数据，分别通过4:1和6:1转换后变 ...
microblaze 只能生成差分clk输入?
2012-3-30 15:02
- FPGA论坛
- 7
- 1802
microblaze 差分clk
2012-3-26 22:46
- FPGA论坛
- 7
- 1778
synplify 编辑 Xilinx库
2013-8-6 08:38
- FPGA论坛
- 17
- 3419
ISE后仿
2012-3-15 21:39
- FPGA论坛
- 2
- 1484
ISE后仿
2012-3-16 14:58
- FPGA论坛
- 3
- 1422
Modelsim下对ISE生成的PAR文件进行后仿
2012-3-15 12:28
- FPGA论坛
- 1
- 1806
Modesim 编辑 ISE的VHDL相关库
2013-12-26 17:17
- FPGA论坛
- 18
- 2174
能不能发个Synplify.Premier9.6.2
2012-3-30 15:05
- FPGA论坛
- 11
- 1981
Spartan6 Core Generator DDR3
2012-3-1 14:56
- FPGA论坛
- 22
- 4211
视频消隐
2012-2-24 21:33
- FPGA论坛
- 12
- 1812
2
3
近期访客