Altera推出Serial RapidIO IP内核
2012-11-24 20:46
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哼，太晚了。
请问这个时序verilog如何实现
2012-11-24 20:27
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不会
Libero9.1烧写反熔丝的FPGA时出错。
2012-11-21 11:46
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- 2030
这个是Actel的？
Xilinx发展历程(1984-2004)
2012-11-24 20:46
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;P
Verilog HDL建模概述
2013-1-13 22:11
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不错
verilog怎么在不同文件的模块间传递参数？
2012-11-16 21:56
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是固定的数值，比方A=1,
然后模块1和模块2全部使用A=1么？
FPGA图像处理－项目外包
2012-12-23 17:28
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哎，我是北京的，我还想给你介绍一个人。
还是杭州找吧。
:)
北京的么？？
硬件项目设计心得
2013-7-17 23:48
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估计结婚了好多年了。
CPLD开放服务
2013-7-23 00:13
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嗯，讲讲具体的呗。
刚推出一个 n 合 1 调试器，给大家过过目
2013-8-15 09:44
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白送我一个啊。
跪求大神指点
2012-11-24 20:49
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;P为什么谢谢猴哥呢？
基于FPGA/CPLD设计与实现UART
2013-8-12 20:17
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清晰，详细。
21IC上的大牛太多了，以后跟你们混了！
2012-11-18 16:52
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跟定猴哥了。
查表应用中提高DIMM效率的办法
2012-11-9 23:15
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这个不错。
请猴哥帮我介绍个方案
2012-11-15 21:01
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:lol
;P
线性稳压器件(Linear Regulators)：工作原理及补偿（四）
2012-11-12 21:28
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嗯，学习了。
求助：Libero9.1中WaveFomer的使用问题
2012-11-22 08:11
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什么FPGA能用到这个？
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