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7系列GTX在CPRI下的应用
2013-9-5 12:48
  • FPGA论坛
  • 1
  • 1480
  猴哥厉害啊  
VHDL语法问题
2013-7-30 08:01
  • FPGA论坛
  • 4
  • 1327
  你定义的Z_BUS是3 downto 0貌似使用的时候只能是downto?  
终于明白寄存器的CE端真正的作用了
2013-7-3 09:12
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  • 9
  • 3866
  y一般不用,呵呵:lol  
  我也不知道唉,呵呵,这个不是就是触发器的使能端么,怎么可以用作时钟?:lol ...  
ISE警告
2013-7-21 20:57
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  • 22
  • 3540
  三态没配置。呵呵  
ISE目录下面的东西值得大家学习。
2013-6-29 10:32
  • FPGA论坛
  • 19
  • 2476
  呵呵怎么收费啊?效果如何啊?  
  怎么个收费方式?效果如何?:lol  
  我也是这么想得,呵呵,有XILINX的培训之类的消息吗:lol  
  猴哥,我想整个东西,可是想选个片子,具体要求是可以出10路1G的差分信号,走背板,不知道选哪个合适啊? ...  
  恩。值得学习啊,呵呵  
CPLD的罕见问题
2013-7-8 09:48
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  • 13
  • 2073
  貌似164245是一种总线保持行CMOS芯片,呵呵,输出关断是需要一点电流的,同时他的输入阻抗很大,稍微输入有 ...  
modelsim必会仿真教程
2015-1-22 14:46
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  • 46
  • 5812
  有点小像啊,哈哈  
  :lol咱们是一个家族的,不是坏人  
  学习学习啊,哈哈  
altera 还是 xilinx ?
2014-5-23 11:09
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  • 117
  • 22018
  XILINX支持者,哈哈  
Spartan-3 DCM使用求助
2013-12-5 19:35
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  • 14
  • 4574
  哈哈,个人理解啊,不知道对不对,欢迎来指正,貌似是你这样用会把DCM给直接短接掉了,所以会报错,因为 ...  
Altera PLL仿真问题
2013-6-2 12:58
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  • 17
  • 2791
  这个仿真结果是正确的啊,因为PLL有个锁相过程,所以在你的PLL复位后需要有段时间的锁相时间是红的,只有 ...  
GSM教你使用PlanAhead进行 I/O Pin Planning(更新完成)
2013-12-5 15:58
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  • 81
  • 16184
  :D经常来,呵呵,不过我是个新手,还需跟各位大虾多学习哈  
时钟问题求助
2015-3-23 13:59
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  • 2
  • 1161
  好的,谢谢,我在看看  
  XILINX芯片在place时,报以下错误ERROR:Place:1138 - Automatic clock placement failed. Please attempt t ...  
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