请问一个时钟的问题
2007-5-27 14:14
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指点一下。谢谢！
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谢谢！
FPGA输出的时钟频率可以是0～60M，实现对AD转换频率的控制。但不知道FPGA输出时钟的抖动是否能满足AD的要求 ...
正常情况下抖动是多少？AD转换器要求十几个ps。
芯片发生震荡？？？
2008-1-29 15:43
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设计上应该没有问题吧
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？
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请问如何将一个脉冲信号幅值升高？
2007-9-7 16:37
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DC-DC,放大器，觉得有点复杂：）
请问一个关于AD和参考电源的弱问题
2008-1-11 17:14
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没有这两个指标啊
三极管应用的简单问题
2007-12-22 16:34
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那么上升沿就会变缓吧？
楼上能详细说明一下吗？谢谢！
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