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请问如何消除过冲

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 楼主| zihengstar 发表于 2007-10-23 15:13 | 显示全部楼层 |阅读模式
脉冲, FPGA, PGA, 定时
FPGA输出了脉宽50ns的脉冲，过冲太大，稳定时间也比较长，上升和下降沿的剑锋大概比正常脉冲高了一倍，请问有什么办法能消除吗？
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michael_li 发表于 2007-10-23 16:24 | 显示全部楼层

這個估計你layout出了問題

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PLAYFPGA 发表于 2007-10-24 09:35 | 显示全部楼层

1

要不就串个电阻
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