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技术交流 嵌入式 单片机 FPGA 时钟信号 正弦波
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Anxsh588 发表于 2024-11-7 14:36 谢谢大佬,bank电压调成1.2V也识别不了削峰正弦,现在打算换同封装的方波晶振试试 ...
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2024-11-11
sleepybear 发表于 2024-11-6 12:05 得看FPGA接收bank的电平标准:你板子上给的FPGA该bank的VCCO电压是多少V的?FPGA固件设置的电平标准是什么 ...
2024-11-07
青木山水 发表于 2024-11-7 09:06 3.3V的bank高电平差不多2.3V左右哦才有效,你可以把这个晶振连接到1.2V、1.8V的BANK,或者换一个同封装CMOS ...
2024-11-06
青木山水 发表于 2024-11-6 09:34 上图纸,你晶振连接FPGA的bank是多少伏?
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tyw
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天意无罪
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xch
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jjjyufan
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coody
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LcwSwust
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chunyang
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tpgf
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不大可能,你程序有问题吧
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2024-11-11
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谢谢大佬,bank电压调成1.2V也识别不了削峰正弦,现在打算换同封装的方波晶振试试
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2024-11-07
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谢谢大佬,bank电压调成1.2V也识别不了削峰正弦,现在打算换同封装的方波晶振试试
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2024-11-07
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2024-11-07
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得看FPGA接收bank的电平标准:你板子上给的FPGA该bank的VCCO电压是多少V的?FPGA固件设置的电平标准是什么?(是LVCMOS还是LVTTL或者什么其它的?)后者的高低电平定义可以在FPGA讲IO的手册里查到。输入信号符合即可。如果两边有差异,就想办法呗,该加leverl shifter加level shifter,该加端接网络加端接网络,该改FPGA固件约束文件的电平标准就改约束文件,或者干脆把源端器件换了。。。
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2024-11-06
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接的3.3V
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2024-11-06
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2024-11-06
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2024-11-06
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