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[FPGA]

【锆石科技】关于 Verilog HDL 语言的一些关键问题解惑

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楼主: 锆石科技
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241楼
霸天虎| | 2017-9-7 11:44 | 只看该作者 回帖奖励 |倒序浏览
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242楼
yangxijun1992| | 2017-9-7 18:00 | 只看该作者
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243楼
史上第一胖| | 2017-9-7 21:57 | 只看该作者
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244楼
fanbinqi| | 2017-9-9 09:00 | 只看该作者
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245楼
霸天虎| | 2017-9-9 14:43 | 只看该作者
always @ (posedge CLK or negedge RST_N)

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246楼
霸天虎| | 2017-9-10 14:30 | 只看该作者
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247楼
tuyanjun| | 2017-9-10 22:51 | 只看该作者
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248楼
qoomd| | 2017-9-11 11:47 | 只看该作者
have a look!

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249楼
jamesjie| | 2017-9-11 12:57 | 只看该作者
谢谢分享

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250楼
霸天虎| | 2017-9-12 13:51 | 只看该作者
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251楼
霸天虎| | 2017-9-13 11:54 | 只看该作者
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252楼
relaxxxx| | 2017-9-14 16:49 | 只看该作者
多谢楼主分享

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253楼
liangzhuang21| | 2017-9-16 11:49 | 只看该作者
非常感谢

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254楼
霸天虎| | 2017-9-16 16:13 | 只看该作者
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255楼
fuchun| | 2017-9-16 23:12 | 只看该作者

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256楼
foxglove| | 2017-9-17 07:01 | 只看该作者
感谢提供资料

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257楼
13207102205| | 2017-9-17 11:34 | 只看该作者
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258楼
霸天虎| | 2017-9-18 20:44 | 只看该作者
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259楼
霸天虎| | 2017-9-19 13:11 | 只看该作者
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260楼
AXIK| | 2017-9-19 19:00 | 只看该作者
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