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版主
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使用特权
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资深工程师
airwill 发表于 2017-11-2 20:43 非常同意楼上的方法. 补充一点思路 CLOCK 可以用系统时钟输出功能引脚, 把主频分频后输出. RD/CONVST脉冲可 ...
qmmdzd 打赏了 20.00 元 2017-11-03 理由:感谢开贴相助
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资深技术员
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中级技术员
玄德 发表于 2017-11-2 21:57 也算讨论了一些内容,不知道你有什么看法? @qmmdzd 前面多次用到DMA,设置比较费力。
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2万
技术总监
玄德 发表于 2017-11-1 22:19 坛友的需求基本是这样: STM32F103控制ADS8363,高速控制AD转换和数据读取,速度尽可能高;(所以,IO口模 ...
pmp 发表于 2017-11-3 22:44 以前使用FPGA做两路采集和一路输出没有压力。
qmmdzd 发表于 2017-11-5 09:56 这里有个问题想问下 如果先采集把数据存储在一个数组中 等全部采集完再处理可以吗?因为整个信号周期几个 ...
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技术达人
2D$1)@UQRDRZ1`LV2LJW1}T.png (51.45 KB )
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2017-11-13 10:38 上传
还有看这个时序发送3次8位数 第一个8位数前两个发00对吗
qmmdzd 发表于 2017-11-13 09:12 请教玄德 如果两路数据输出 也就是SDOA和SDOB同时输出 而SPI只有一个MISO引脚 这该如何连?还是只能是选择 ...
qmmdzd 发表于 2017-11-13 10:42
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玄德 发表于 2017-11-13 17:44 后面的工作模式,我没有时间认真看。 靠你自己了。
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