ARM core 介绍
一、ARM处理器的特点
（1）支持的数据类型
A.字节 8bit
B.半字 16bit
C.字 32bit
（2）采用32位精简指令集（RISC）处理器架构
ARM处理器可以工作在两种状态：
A 。 ARM状态
指令长度为32位，这种状态执行的是字对齐方式的ARM指令
B. Thumb状态
指令长度为16位，这种状态执行半字对齐方式的Thumb指令
主意：这两个状态间的切换并不影响处理器模式和寄存器内容
小知识：RISC和CISC
指令的强弱是CPU的重要指标，指令集是提高微处理器效率的最有效工具之一。从现阶段的主流体系结构讲，指令集可分为复杂指令集（CISC）和精简指令集（RISC）两部分。相应的，微处理随着微指令的复杂度也可分为CISC及RISC这两类。
CISC是一种为了便于编程和提高**体访问效率的晶片设计体系。在20世纪90年代中期之前，大多数的微处理器都采用CISC体系——包括Intel的80x86和Motorola的68K系列等。即通常所说的X86架构就是属于CISC体系的。RISC是为了提高处理器运行的速度而设计的晶片体系。它的关键技术在于流水线操作（Pipelining）：在一个时钟周期里完成多条指令。而超流水线以及超标量技术已普遍在晶片设计中使用。RISC体系多用于非x86阵营高性能微处理器CPU。像ARM（Advanced RISC Machines），既可以认为是一个公司的名字，也可以认为是对一类微处理器的通称，还可以认为是一种技术的名字。而ARM体系结构目前被公认为是业界领先的32位嵌入式RISC 微处理器结构。所有ARM处理器共享这一体系结构。
（1）CISC
CISC复杂指令系统计算机通过增强计算机指令系统功能，通过程序去执行大量功能各异的指令，从而优化计算机系统的性能。
由于具有大量的指令，因此CISC体系的优缺点也很明显。
优点：
a）具有丰富的指令系统，很大程度上简化了程序设计的难度。
b）CISC中不要求指令长度统一，可以节省存储空间。
c）CISC指令可以直接对存储器操作，使得通用寄存器数目较少。
同时CISC指令系统也带来很多问题：
a）由于指令系统庞大，寻址方式、指令格式较多，指令长度不一，增加了硬件复杂程序，设计成本较高。
b）指令操作复杂、执行周期长、速度低，难以优化编译生成高效的机器语言。
c）许多指令使用频度低，增加了系统负担，降低了性价比。
（2）RISC
和CISC相比，RISC的指令就要少得多，通常在几十条左右，其基本设计思想是尽量简化计算机的指令功能，从而降低硬件执行指令的复杂度，因为软件比硬件容易提供更大的灵活性和更高的智能。因此CISC的主要特点如下：
a） 精简指令集：只保留了数量很少、功能简单、能在一个机器周期内完成的指令，如果要执行复杂的程序功能则通过子程序而不是使用复杂指令来实现。
b）指令长度相同：每条指令的长度都是相同的，可以在一个单独操作里完成。
c） 单机器周期指令：大多数的指令都可以在一个机器周期里完成，并且允许处理器在同一时间内执行一系列的指令。
使用RISC指令具有以下优势：
a） 精简指令系统的设计适合超大规模集成电路的实现。由于指令条数相对较少，寻址方式简单，指令格式规整，与CISC结构相比，控制器的译码和执行硬件相对简单，因此芯片中用于实现控制器的晶体面积明显减小。
b）在使用相同的晶片技术和相同运行时钟下，RISC系统具有更快的运行速度。精简的指令系统可以加快指令的译码，控制器的简化可以缩短指令的执行延时等，这些都可以提高程序的执行速度。
c）可以提供直接支持高级语言的能力，简化编译程序的设计。指令总数的减少，缩小了编译过程中对功能类似的机器指令的选择范围，减轻了对各种寻址方式进行选择、分析和变换的负担，易于更换或取消指令、调整指令顺序，提高程序运行速度。
d）RISC处理器比相对应的CISC处理器设计更简单，所需要的时间将变得更短，并可以比CISC处理器应用更多先进的技术，开发更快的下一代处理器。
相应的，RISC也存在一些缺点，主要有：
a） 由于指令少，因此加重了汇编程序员的负担，增加了机器语言程序的长度，从而占用了较大的存储空间。
b） 相对来说，RISC对编译器的要求更高，因为指令简单，RISC结构的性能就依赖于编译器的效率。编译器的优劣直接影响处理器的性能发挥。
综合上面所述，若要再进一步比较CISC与RISC之差异，可以由以下几点来进行分析：
1、指令的形成：CISC因指令复杂，故采微指令码控制单元的设计，而RISC的指令90%是由硬体直接完成，只有10%的指令是由软体以组合的方式完成，因此指令执行时间上RISC较短，但RISC所须ROM空间相对的比较大，至于RAM使用大小应该与程序的应用比较有关系。
2、定址模式：CISC的需要较多的定址模式，而RISC只有少数的定址模式，因此CPU在计算**体有效位址时，CISC占用的周期较多。
3、指令周期：CISC指令的格式长短不一，执行时的周期次数也不统一，而RISC结构刚好相反，故适合采用管线处理架构的设计，进而可以达到平均一周期完成一指令的方向努力。显然的，在设计上RISC较CISC简单，同时因为CISC的执行步骤过多，闲置的单元电路等待时间增长，不利于平行处理的设计，所以就效能而言RISC较CISC还是站了上风，但RISC因指令精简化后造成应用程式码变大，需要较大的程式**体空间，且存在指令种类较多等等的缺点。
4、大量使用寄存器
二、ARM处理器的模式与异常
ARM体系结构主要支持7种处理器模式，分别为 ： 用户模式、快中断模式、中断模式、管理模式、中止模式，未定义模式和系统模式
（1）系统（sys），快中断（fiq）、中断（irq）、管理（svc）、中止（abt）、未定义（und）这六种模式成为特权模式
（2）快中断（fiq）、中断（irq）、管理（svc）、中止（abt）、未定义（und）
思考：为什么处理会被设计成这么多模式呢？
处理器之所以被设计出这么多模式的目的是为了能够更好地处理各种异常。
那什么是异常呢？所谓的异常，指的就是中止了程序正常执行的过程而不得不去完成的一些特殊工作，如芯片复位，取指失败，指令未定义，等等。
有些同学在大学的时候，学过51单片机，知道中断的概念。在这里中断其实也是一种异常，这里的中断包括外部硬件产生的外部中断和由芯片内部硬件产生的内部中断。由中断产生的异常和其他异常，从处理方法的角度来看没有任何区别，所以我们可以把这些异常统一起来研究。
注意：在正常情况下，一个普通程序可能会运行在用户模式和系统模式下，当异常发生时，ARM就会自动切换到异常模式去处理异常，处理完后，又回到用户模式或系统模式下继续之前的工作。因为每一种模式都包含相应的私有资源，因此可以保证在处理异常的时候，原理的程序环境不会被新的环境破坏，从而保证了系统的正常工作。注意：在正常情况下，一个普通程序可能会运行在用户模式和系统模式下，当异常发生时，ARM就会自动切换到异常模式去处理异常，处理完后，又回到用户模式或系统模式下继续之前的工作。因为每一种模式都包含相应的私有资源，因此可以保证在处理异常的时候，原理的程序环境不会被新的环境破坏，从而保证了系统的正常工作。
好了，关于ARM的异常和工作模式就介绍在这里，接下来我们来看看ARM每种模式下所拥有的寄存器。
三、ARM每种模式拥有的寄存器
前面我们讲到，ARM使用的是RSIC架构，而RSIC架构特点之一就是使用大量寄存器。ARM处理器支持多模式，每种模式都有一些寄存器是公用的，有一些是私有的
这里可以简单总结一下：
（1）ARM总共有37个寄存器，其中R0-R7，CPSR，R15（pc）是任何模式下都公用的的寄存器
（2）用户模式和系统模式使用相同的寄存器R0-R15，CPSR
（3）每种异常模式都有自己的 SPSR，R13，R14
（4）FIQ模式除了公共R0-R7寄存器外，还有自己私有的R8-R12，其他模式没有自己私有的R8-R12寄存器
注意：Cortex体系结构下有40个32-Bits长的寄存器Cortex-A多出3个寄存器，Monitor 模式 r13_mon ， r14_mon， spsr_mon
接下来我们一起来看看这些寄存器都有什么作用吧。
四、ARM中每个寄存器的用途
（1）R0-R12 这些寄存器我们可以随便使用，就像我们写C语言一样，都需要定义变量，在ARM的世界里，这些就是已经定义好的变量，可以直接拿来使用，每个都可以用来存放一个32bit的数哦。
（2）R13，R14这两个寄存器就要注意了，前面我们分析过，在所有的异常模式下都有自己的私有的R13，R14，即每种异常模式在操作R13和R14，不会对其他模式下R13和R14的值产生影响。
R13我们又叫做sp，也就是我们常说的栈指针。大家C语言的局部变量时需要入栈的，也就是说不管在那一种模式下，如果我们想调用C语言程序，那在之前先设置好对应模式的sp指针。
R14为链接寄存器（LR），在结构上有两个特殊功能：
（1）在每种模式下，模式自身的R14用于保存子程序返回地址；
（2）当发生异常时，将R14对应的异常模式设置为异常返回地址（有些异常有一个小的固定偏移量）。
（3）寄存器R15为程序计数器（PC），它指向正在取指的地址。也就说R15保存的是那一条指令的地址，CPU就会预取那一条指令。
（4）寄存器CPSR为程序状态寄存器，它时刻记录CPU的状态
CPSR记录了处理器当前工作的模式，FIQ、IRQ中断是否使能，指令带条件执行结果等信息。
下面我们详细来看看每一位分别代表什么意思：
A.条件代码标志
（N ） 运算结果的最高位反映在该标志位。对于有符号二进制补码，结果为负数时N=1，结果为正数或零时N=0；
（Z ） 指令结果为0时Z=1（通常表示比较结果“相等”），否则Z=0；
（C ） 当进行加法运算（包括CMN指令），并且最高位产生进位时C=1，否则C=0。当进行减法运算（包括CMP 指令），并且最高位产生借位时 C=0，否则C=1。对于结合移位操作的非加法/减法指令，C为从最高位最后移出的值，其它指令C通常不变；
（V）进行加法/减法运算，并且发生有符号溢出时V=1，否则V=0，其它指令V通常不变。
B. 中断禁止位包括I和F位
当I位置位时，IRQ中断被禁止；
当F位置位时，FIQ中断被禁止。
C.T位反映了正在操作的状态
当T位置位时，处理器正在Thumb状态下运行；
当T位清零时，处理器正在ARM状态下运行。
D.模式位
模式位包括M4、M3、M2、M1和M0，这些位决定处理器的操作模式。
10000 User mode ; 10001 FIQ mode; 10011 SVC mode ; 10111
Abort mode ; 11011 Undfined mode;
11111 System mode; 10110 Monitor mode; 10010 IRQ
注意：不是所有模式位的组合都定义了有效的处理器模式，如果使用了错误的设置，将引起一个无法恢复的错误
（5）SPSR 程序状态保存寄存器
每种异常都有自己的SPSR，在因为异常事件而进入异常时它保存CPSR的当前值，异常退出时可通过它恢复CPSR。
五、Thumb状态下的寄存器
ARM状态和Thumb状态之间寄存器的关系
Thumb状态寄存器与ARM状态寄存器有如下的关系：
Thumb状态R0～R7与ARM状态R0～R7相同；
Thumb状态CPSR和SPSR与ARM状态CPSR和SPSR相同；
Thumb状态SP映射到ARM状态R13；
Thumb状态LR映射到ARM状态R14；
Thumb状态PC映射到ARM状态PC（R15）。
注意： 在Thumb状态中，高寄存器（R8～R15）不是标准寄存器集的一部分
六、ARM异常处理
前面我们已经说过异常了，所谓的异常可以理解为CPU的正常执行被打断，而不得不去完成一些特殊的工作。有些同学可能感觉还是有点抽象，举个例子说明一下吧：假如你正在努力的写代码，这个时候你肚子饿了，必须得解决呀，你就停止写代码，去吃饭了，吃完饭你又继续写代码了，过了一会，你的瞌睡虫来找你了，必须得睡觉呀，都三天三夜没睡了。睡完之后，你又开始写代码。这里的肚子饿，瞌睡虫就可以理解成异常情况，必须得处理，处理完后还得恢复以前的状态。
那异常产生的时候，硬件上会自动做那些事情呢？注意是硬件自动做的哦，不需要我们介入的。
当一种异常发生时，硬件就会自动执行如下动作：
（1）将CPSR保存到相应异常模式下的SPSR中
（2）把PC寄存器保存到相应异常模式下的LR中
（3）将CPSR设置成相应的异常模式
（4）设置PC寄存器的值为相应处理程序的入口地址
细心的同学就会发现，这里的PC寄存器的值不是应该指向正在执行的指令吗？为什么图中却指向了正在提起的指令，这里的“正在提取”又有什么含义呢？呵呵，这就涉及到流水线的问题了，关于流水线我们后面会介绍的。
这里我们还是先搞明白，异常产生的时候，硬件应该将PC值设为多少呢？要想明白这个问题，还必须先知道一个概念“异常向量表”。
ARM一共有5种异常模式，按道理，每一种异常模式都应该有一个唯一的入口地址。这些入口地址彼此相邻，我们一般称之为异常向量表。
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