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写进FIFO的却是n+1个数据

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sdlls 发表于 2019-5-29 16:42 | 显示全部楼层
可能是你的硬件问题  
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pixhw 发表于 2019-5-29 16:42 | 显示全部楼层
读取的时候有问题吗   
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febgxu 发表于 2019-5-29 16:43 | 显示全部楼层
时钟周期是怎么控制的呢   
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kkzz 发表于 2019-5-29 16:43 | 显示全部楼层
你的FPGa怎么写入的呢？
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xiaoyaodz 发表于 2019-5-29 16:43 | 显示全部楼层
你的CLK怎么控制的
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hudi008 发表于 2019-5-29 16:43 | 显示全部楼层
自动计数可能多1     
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fentianyou 发表于 2019-5-29 16:43 | 显示全部楼层
写入fifo的时候可能计数器多了一个   
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lzmm 发表于 2019-5-29 16:43 | 显示全部楼层
可能就是长度问题     
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selongli 发表于 2019-5-29 16:43 | 显示全部楼层
以前做FPGA确实很多的问题   
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minzisc 发表于 2019-5-29 16:43 | 显示全部楼层
将寄存器的数值减一看看
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pixhw 发表于 2019-5-29 16:43 | 显示全部楼层
你的FIFO写入的时候数量是统计出来的吗？
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sdlls 发表于 2019-5-29 16:43 | 显示全部楼层
是写入cypress芯片的有问题吗？   
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