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开始分析
- stc_clk_sysclk_cfg_t stcSysClkCfg;
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这个是第一行代码
具体是什么拆开看一下
- /**
- *******************************************************************************
- ** \brief Configuration structure of system clock.
- **
- ** \note Configures the system clock if needed.
- **
- ******************************************************************************/
- typedef struct stc_clk_sysclk_cfg
- {
- en_clk_sysclk_div_factor_t enHclkDiv; ///< Division for hclk.
- en_clk_sysclk_div_factor_t enExclkDiv; ///< Division for exclk.
- en_clk_sysclk_div_factor_t enPclk0Div; ///< Division for pclk0.
- en_clk_sysclk_div_factor_t enPclk1Div; ///< Division for pclk1.
- en_clk_sysclk_div_factor_t enPclk2Div; ///< Division for pclk2.
- en_clk_sysclk_div_factor_t enPclk3Div; ///< Division for pclk3.
- en_clk_sysclk_div_factor_t enPclk4Div; ///< Division for pclk4.
- }stc_clk_sysclk_cfg_t;
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系统时钟配置结构体,怎么配置的呢?看下面
- /**
- *******************************************************************************
- ** \brief The division factor of system clock.
- **
- ******************************************************************************/
- typedef enum en_clk_sysclk_div_factor
- {
- ClkSysclkDiv1 = 0u, ///< 1 division.
- ClkSysclkDiv2 = 1u, ///< 2 division.
- ClkSysclkDiv4 = 2u, ///< 4 division.
- ClkSysclkDiv8 = 3u, ///< 8 division.
- ClkSysclkDiv16 = 4u, ///< 16 division.
- ClkSysclkDiv32 = 5u, ///< 32 division.
- ClkSysclkDiv64 = 6u, ///< 64 division.
- }en_clk_sysclk_div_factor_t;
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这个就是了一个联合体 里面定义了一堆的分频系数
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