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23-10-3期【创作大赛】分享原创话题,赢千元现金大奖

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21ic小管家|  楼主 | 2023-10-24 09:40 | 显示全部楼层 |阅读模式
#每日话题# #有奖活动#

话题10月【第三期】,参与立享家园币奖励,更有大额红包等你来拿~~~

话题(一):蓝牙5.4的室外传输距离已经可以达到1km,这在以前,是LoRa或NB-IoT才能实现的距离。你有做过蓝牙长距离无线传输的项目吗?有什么关于低功耗长距离设计的分享?
话题(二):双十一将至,大战一触即发!你有什么电子工程师值得撸的好物推荐吗?欢迎分享自己的电子工程师双十一作战计划
话题(三):OpenAI也想入局的GPU是个啥?
话题(四):FTTR-H和FTTR-B有什么区别?
话题(五):经验之谈:如何高效阅读项目代码?

温馨提示:结合以上话题,用户自由发挥创作,禁止照搬以上“话题”为作品的“主题帖标题”(本活动与#申请原创活动同享奖励,可享双份打赏

活动奖励:
参与奖:参与必奖200家园币
优秀奖:优质内容奖励10~50元论坛打赏红包;
月度奖:包含最佳内容奖持续打卡奖贡献数量奖奖励50~100元(即:最优内容、每期活动创作至少一篇、本月分享最多作品数量)
年度奖:月度评选中优胜作品将参与年度评选,第一名奖励1000元论坛打赏红包;
本活动对作品内容,字数、配图等未作限制,但优质内容可获得更高奖励~~~

活动时间:2023年10月23日~2023年10月31日

参与方式:
(1)结合“创作话题”发表包含个人信息增量的“主题帖”内容;
(2)选择“Microchip”论坛发布话题内容→戳此即可跳转编辑页面
(3)发布成功后,需复制主题帖链接回复至本帖的评论区


评选规则:
一、按内容质量给予打赏参与奖/优秀奖;
二、内容需为作者原创并首次发布,禁止抄袭/搬运他人内容;
三、内容要求已主题帖的形式发布后,将主题帖链接回复到本帖评论区,视为成功参加;
四、参加本活动作品,不与论坛其他原创类活动同享;
五、若当月的优秀奖作品少于10篇,全年的优秀奖作品少于80篇则取消月度奖/年度奖评选,给予入围作品其他奖励
六、月度奖所包含的三项不同奖励,要求分享作品均需符合优秀奖标准;



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leslietian 2023-10-30 12:57 回复TA
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yinxiangxv| | 2023-10-24 15:55 | 显示全部楼层
FTTR-H和FTTR-B是光纤到户(FTTH)的两种典型架构。

FTTR-H(Fiber to the Home - Home Run)是一种架构,它将光纤从中心交换机(例如OLT)以单一的方式直接延伸到每个用户家庭。在FTTR-H中,每个用户都有一根单独的光纤连接到交换机,这样可以提供高带宽和低延迟的通信。

FTTR-B(Fiber to the Home - Bus)是另一种架构,它使用光纤作为主干线路将信号传输到小区或楼栋,然后再通过分纤箱将信号分配给每个用户。在FTTR-B中,多个用户可能共享同一根光纤,这可以降低网络部署成本。

两种架构的优劣势如下:

FTTR-H架构优势:
提供每个用户独立的高带宽连接,不受其他用户影响。
可以支持更高的网络速度和更低的延迟。
用户之间不会分享带宽,因此网络性能更稳定。

FTTR-B架构优势:

部署成本相对较低,因为光纤线路可以与其他用户共享。
适用于住宅区或楼栋密集的地方,可以更好地满足大量用户的需求。

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21ic小管家 2023-10-25 14:05 回复TA
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yinxiangxv| | 2023-10-24 16:09 | 显示全部楼层
- FTTH(光纤到户):光纤直接连接到用户的家中,提供最高的带宽和可靠性。
- FTTB(光纤到建筑物):光纤连接到建筑物的共享电气室,信号使用非光学方式(例如双绞线或同轴电缆)传送到各个单元。
- FTTC(光纤到路边):光纤延伸到用户家附近的机柜,并使用铜缆或同轴电缆将信号传输到家中。
- FTTN(光纤到节点):光纤运行到用户家庭附近的节点,并使用铜缆或同轴电缆将信号传送到家庭。
光纤到户按照光纤末端的位置可分为:

FTTH(光纤到户)是一种到达一个生活或工作空间的光纤通信传输形式。光纤从中心局延伸到用户的生活或工作空间。一旦到达订户的生活或工作空间,信号就可以使用任何方式在整个空间中传送,包括双绞线、同轴电缆、无线、电力线通信或光纤。
FTTB(光纤到建筑物或地下室)是光纤通信传输的一种形式,仅适用于包含多个生活或工作空间的房产。光纤在实际到达订户生活或工作空间本身之前终止,但确实延伸到包含该生活或工作空间的财产。使用任何非光学方式(包括双绞线、同轴电缆、无线或电力线通信)将信号传送到最终距离。
公寓楼可以提供 FTTH 和 FTTB 之间区别的示例。如果光纤连接到每个用户公寓单元内的面板,则称为 FTTH。如果相反,光纤仅到达公寓楼的共享电气室(仅到达底层或到达每层),则为 FTTB。
大多数 FTTH 部署遵循四种主要架构类型之一:集中式拆分、分布式拆分、星型架构或菊花链。光纤网络开发人员根据多种因素选择架构,例如当地环境的自然地理、预期用户数量和劳动力技能.


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21ic小管家 2023-11-3 09:57 回复TA
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xiaoxi2023| | 2023-10-25 11:12 | 显示全部楼层
本帖最后由 xiaoxi2023 于 2023-10-25 11:17 编辑

图形处理单元 (GPU) 的发展是一个渐进的过程,跨越了几十年。 以下是 GPU 从最初状态到目前技术水平的演变的总结:
- 3D 消费类图形的早期阶段:第一个真正的 3D 图形始于早期的显示控制器,称为视频移位器和视频地址生成器。 它们充当主处理器和显示器之间的通道。 早期的图形系统具有固定功能管道 (FFP) 和遵循非常严格的处理路径的架构,利用几乎与 3D 芯片制造商一样多的图形 API。
- PC 上 3D 的兴起:在 20 世纪 90 年代,桌面 3D 工作站变得更加便宜,单板、多芯片图形子系统变得更加普遍。 PC 上 3D 的兴起导致科学界采用 GPU。
- Nvidia 和 AMD:Nvidia 和 AMD 多年来一直是 GPU 市场的主要参与者。 Nvidia 在五月份推出了他们的第一款图形芯片 NV1,并成为第一款商用 GPU。 AMD还凭借其Radeon系列显卡为GPU市场做出了重大贡献。
- 高性能计算(HPC)特性:凭借HPC特性、高性能和高效率,GPU迅速成为大型科学计算机的首选技术。 GPU 的一个重要里程碑是 Nvidia 在 2007 年推出了 CUDA(统一计算设备架构),它允许开发人员使用 GPU 进行通用计算。
- 通用计算:GPU 的快速发展可以追溯到 20 世纪 90 年代末的一个关键时刻,当时研究人员开始探索通过使用并行计算机架构来提高计算机图形速度的方法。 这种并行计算机架构是 GPU。 将并行 GPU 作为行业标准将焦点从娱乐转移到并行处理。
- 当前状态:当今的 GPU 构建在单个芯片上,该芯片上挤满了数百(甚至数千)个 GPU。 这些 GPU 设计用于同时执行许多编程指令,并且可以通过编程来快速执行各种计算机图形和通用任务。 用于了解有关 GPU 发展的更多信息的开源资源包括 IEEE 计算机协会,它提供了有关 GPU 发展及其在 HPC 中的使用的信息,以及 TechSpot 网站 ,它提供了对历史的广泛了解 GPU 的。 此外,Nvidia 网站提供了有关通用计算 GPU 发展的信息。

总而言之,GPU的发展是一个渐进的过程,跨越了几十年。 GPU已经从早期的显示控制器发展成为用于通用计算的高性能计算设备。 有多个开源资源可用于了解有关 GPU 发展的更多信息,包括 IEEE 计算机协会和 TechSpot 网站。
那么我们在设计GPU的时候要考虑什么问题呢?有没有什么好的参考方案呢?这个还真有,我们首先从一篇文章开始:
这篇文章主要介绍如何用FPGA进行GPU相关的设计的。
图形处理单元(GPU)旨在并行地对多个图形输入数据执行高度数学计算。输入数据是图形基元,例如浮点单元类型的多边形结构。GPU的处理**要是对输入的图形基元顶点进行三角剖分。
GPU内部涉及的计算是高度并行和复杂的。运动图像的实时图形处理需要高精度、高精度的算法来实现运动图像的平滑过渡。
GPU主要负责进行光栅化过程、几何引擎、纹理、碎片化等相关的处理
5592565387d8cd93e8.png
除了光栅化过程渲染像素外,它还执行对象的照明、阴影和颜色,这需要被指示绘制的对象的附加属性。纹理是在给定对象的顶部用2D图案或色调包裹3D对象的过程。
片段是生成必要像素的过程,这些像素值得将基元绘制到帧缓冲区中。图形流水线在不同的时间对不同的数据执行相同的指令。
GPU框架设计的基本组成部分是光栅化、内存控制器、DDR3中的三显示缓冲区、视频图形控制器设计。主应用程序通过生成指令来驱动FPGA上的GPU块。
FPGA内部实现的GPU基本设计构建块如图2所示:
1259965387e76c208f.png
光栅化作用于指令包结构上可用的基元顶点。渲染/光栅化逻辑用于计算DDR3的内存地址。反过来,存储器地址被映射到投影屏幕位置。
在提供的坐标超出投影屏幕分辨率的情况下,设计逻辑确保所有这些区域都被剪裁。屏幕坐标与X和Y方向上的绝对屏幕位置之间的映射如图4所示
944065387ff43c693.png
用于根据设计分辨率的给定屏幕坐标计算绝对屏幕位置的公式
440776538808723491.png
478716538812791d4b.png
存储器控制器核心[11]用于访问DDR3存储器,用于读取和写入操作,以及配置端口上的仲裁逻辑。
整个屏幕分辨率像素被映射到DDR3内存位置,用于视频缓冲。整个XGA分辨率被映射到3072KB的DDR3存储区域(1024*748*4字节),其中每个像素数据为4字节。
像素颜色存储在DDR3中用于像素照明。DDR3内存映射如图5所示
8581653882490e452.png
光栅化设计会更新每个像素的内存位置。每个像素包括三种基色(RGB)。用于内存控制器的接口命令包括要读/写的字数、读/写指令和读/写操作的内存地址。
执行读写操作的流程图分别如图6和图8所示。
30388653883198b685.png
798106538833830300.png
读取和写入操作之间的区别在于数据和命令的顺序,如图6和图8所示。在读取时,设计逻辑在数据之前先发送读取命令。
但在写入时,设计逻辑在写入数据后发送写入命令。反过来,内存控制器负责通过指定的端口进行写/读过程。
在读取和写入之前,将分别检查控制器数据FIFO的满状态和空状态。
缓冲区只是DDR3中的内存区域(大小3072KB)。在屏幕上显示之前,已使用三重缓冲机制将全帧内容缓冲在3个显示缓冲区中。
光栅化逻辑根据来自主机应用程序的指令直接绘制到操作缓冲区中。
构建这种缓冲方案所需的总内存缓冲区大小是DDR3内存中的12MBytes,DDR3内存包括一个操作缓冲区和三个显示缓冲区。
142466538847a5cb2a.png
视频图形控制器设计为XGA分辨率生成水平、垂直同步和数据启用控制信号以及RGB颜色数据。像素时钟频率主要取决于显示系统的刷新率及其分辨率。
在这种设计中,显示器的刷新率为60Hz。根据VESA标准生成控制脉冲的标准脉冲计数如表所示
2809365388620cd326.png
以下将各种大小的点视为本文中的样本,以显示存储器地址计算,然后在屏幕上显示实验设置和结果,屏幕的不同位置显示不同大小的各种点,如图14所示。
案例1和案例2分别提供了用于渲染不同大小的2和5的点基元的计算。
这些数值的计算是通过简单替换方程(1)至(5)中给定的点尺寸和屏幕坐标(0,0)得出的。

994516538871836058.png 872036538872a9b775.png
最后我们就可以通过设计的GPU核来驱动屏幕了
4186538876643f77.png
参考文献:[color=rgba(0, 0, 0, 0.850980392156863)]http://ieeexplore.ieee.org/document/7807847


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21ic小管家 2023-11-3 09:58 回复TA
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xiaoxi2023| | 2023-10-25 11:24 | 显示全部楼层
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21ic小管家 2023-11-3 10:55 回复TA
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yinxiangxv| | 2023-10-25 11:37 | 显示全部楼层
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yinxiangxv| | 2023-10-26 08:12 | 显示全部楼层
本文主要介绍一些英伟达显卡的进化过程,里面配有图片,详细描述每款显卡的技术参数,和性能提升方面的改进。

英伟达GPU进化史.rar

2.32 MB

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21ic小管家 2023-11-3 10:55 回复TA
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yinxiangxv| | 2023-10-26 08:16 | 显示全部楼层
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xiaoxi2023| | 2023-10-26 08:20 | 显示全部楼层
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76290391| | 2023-10-28 10:14 | 显示全部楼层
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再见十分钟| | 2023-10-30 13:01 | 显示全部楼层

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咕咕呱呱孤寡| | 2023-10-31 09:54 | 显示全部楼层
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shaler| | 2023-10-31 11:11 | 显示全部楼层
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runxin2023| | 2023-10-31 14:21 | 显示全部楼层
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meiyaolei| | 2023-10-31 15:19 | 显示全部楼层
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FTTR-H和FTTR-B
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我是这样阅读项目代码的
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