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高速AD导致地上辐射超标的问题

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楼主: iampeter
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21楼
skm2008| | 2013-6-19 13:01 | 只看该作者 回帖奖励 |倒序浏览
布线也可能产生辐射超标，电源是否与通讯信号线交叉或平行？

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22楼
DYCN| | 2013-6-19 21:26 | 只看该作者
AD本身是不是也要分地?

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23楼
skm2008| | 2013-6-20 11:59 | 只看该作者
DYCN 发表于 2013-6-19 21:26
AD本身是不是也要分地?

分模拟地和数字地

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24楼
skm2008| | 2013-6-28 12:42 | 只看该作者
只能通过结构屏蔽处理了

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25楼
HORSE7812| | 2013-7-9 15:18 | 只看该作者
学习

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26楼
flower_huanghua| | 2013-7-11 08:43 | 只看该作者
对AD加一个屏蔽罩试试。

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27楼
iampeter|  楼主 | 2013-7-12 13:19 | 只看该作者
bdkonly 发表于 2013-6-18 21:04
根本问题是你的时钟线上送出去的电流没有一个低阻抗的回流路径。你完全可以为你的时钟线在AD模块与数字模块 ...

不管是用零欧还是磁阻问题还是存在，在时钟线旁边单独使用一个地线连接还是无效果！！！330M辐射还是达到-60dbm！！！

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28楼
grasswolfs| | 2014-5-8 14:00 | 只看该作者
iampeter 发表于 2013-7-12 13:19
不管是用零欧还是磁阻问题还是存在，在时钟线旁边单独使用一个地线连接还是无效果！！！330M辐射还是达到 ...

这个问题最后怎么解决的，重新做板了么？

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29楼
iampeter|  楼主 | 2014-5-20 16:17 | 只看该作者
grasswolfs 发表于 2014-5-8 14:00
这个问题最后怎么解决的，重新做板了么？

共地，换LVDS输出的AD，降低时钟的幅度！！！

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30楼
grasswolfs| | 2014-5-20 16:21 | 只看该作者
iampeter 发表于 2014-5-20 16:17
共地，换LVDS输出的AD，降低时钟的幅度！！！

降低时钟的幅度是什么意思？阻抗分的？

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31楼
iampeter|  楼主 | 2014-5-20 18:04 | 只看该作者
grasswolfs 发表于 2014-5-20 16:21
降低时钟的幅度是什么意思？阻抗分的？

是的！差分时钟摆幅是200mv左右，3.3V的LVCOMS幅度可以到5V，辐射的能量相差很大！

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32楼
grasswolfs| | 2014-5-20 18:40 | 只看该作者
iampeter 发表于 2014-5-20 18:04
是的！差分时钟摆幅是200mv左右，3.3V的LVCOMS幅度可以到5V，辐射的能量相差很大！ ...

那就是说200mV的差分时钟其实就足够用的，对了，有个问题是前后的指标除了辐射指标，别的性能相比怎么样？

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33楼
iampeter|  楼主 | 2014-5-21 22:37 | 只看该作者
没发现，不同厂家的也不好比，信噪比什么的都满足要求。现在高级的AD都是高速串口输出了，就是FPGA接收数据麻烦点！

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34楼
zch_genius| | 2014-6-17 21:27 | 只看该作者
扩频或延缓上升沿时间试过没，定位到了时钟应该好解决啊

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35楼
kwiewie1988| | 2021-12-6 15:14 | 只看该作者
1.时钟的回流路径上不能出现高阻抗，否则，RF电流遇到高阻抗会形成共模电压，它会驱动共模电流向外部发射；所谓高阻抗如：磁珠、过孔、裂缝、开槽，自己检查是否存在这个问题；2.高速信号，鲜有走地线，这是因为如果足够放一下一根地线，说明距离挺大，串扰影响有限，其次，如果长地线不能每隔二十分之一波长打孔，那么就有可能形成等效天线，还不如不加；

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