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楼主: xyz549040622
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341
ar_m_cu| | 2015-5-28 15:01 | 只看该作者 回帖奖励 |倒序浏览
再来凑个热闹

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342
JY-DX-JY| | 2015-5-28 15:01 | 只看该作者
困死我啦,我差点睡着。

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343
lengbuleng| | 2015-5-28 15:03 | 只看该作者
算我一个,二姨不错

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344
ar_m_cu| | 2015-5-28 15:03 | 只看该作者
再来凑个热闹

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345
honeymls| | 2015-5-28 15:05 | 只看该作者
来晚了  。。。。。。。。。。

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346
wudianjun| | 2015-5-28 15:06 | 只看该作者
模电,这么多年来一直是最薄弱的地方,希望有机会好好补补!

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347
bargage| | 2015-5-28 15:06 | 只看该作者
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;

--模块功能:在曼彻斯特信号的上升沿产生时钟同步脉冲(近似的,模拟的,不是真正的脉冲)

Entity ER IS
PORT
(   
  R      : OUT STD_LOGIC;   
  MANIN  : IN  STD_LOGIC;
  CLK    : IN  STD_LOGIC   --曼彻斯特输入信号   
);
END ENTITY ER;

ARCHITECTURE ONE OF ER IS
SIGNAL MI : STD_LOGIC;
BEGIN
PROCESS(CLK)
BEGIN  
  IF CLK'EVENT AND CLK = '1' THEN
   IF MANIN = '1' OR MANIN = '0' THEN
    MI <= MANIN;
    R <= MI XOR MANIN;
   END IF;
  END IF;  
END PROCESS;
END ONE;

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348
JY-DX-JY| | 2015-5-28 15:06 | 只看该作者
一定要抓住这次机会。

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349
Ketose| | 2015-5-28 15:10 | 只看该作者
进度有点慢啊。。。

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350
honeymls| | 2015-5-28 15:10 | 只看该作者
再来加一层。。。。

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351
bargage| | 2015-5-28 15:10 | 只看该作者
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;

--模块功能:在曼彻斯特信号的上升沿产生时钟同步脉冲(近似的,模拟的,不是真正的脉冲)

Entity ER IS
PORT
(   
  R      : OUT STD_LOGIC;   
  MANIN  : IN  STD_LOGIC;
  CLK    : IN  STD_LOGIC   --曼彻斯特输入信号   
);
END ENTITY ER;

ARCHITECTURE ONE OF ER IS
SIGNAL MI : STD_LOGIC;
BEGIN
PROCESS(CLK)
BEGIN  
  IF CLK'EVENT AND CLK = '1' THEN
   IF MANIN = '1' OR MANIN = '0' THEN
    MI <= MANIN;
    R <= MI XOR MANIN;
   END IF;
  END IF;  
END PROCESS;
END ONE;

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352
JY-DX-JY| | 2015-5-28 15:12 | 只看该作者
机不可失,失不再来。

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353
wudianjun| | 2015-5-28 15:12 | 只看该作者
模电,这么多年来一直是最薄弱的地方,希望有机会好好补补!

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354
波板糖| | 2015-5-28 15:12 | 只看该作者

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355
波板糖| | 2015-5-28 15:13 | 只看该作者
搬砖

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356
ar_m_cu| | 2015-5-28 15:14 | 只看该作者
进度好慢

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357
JY-DX-JY| | 2015-5-28 15:15 | 只看该作者
机会只眷顾那些有准备的人。

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358
波板糖| | 2015-5-28 15:15 | 只看该作者
搬砖

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359
Ketose| | 2015-5-28 15:15 | 只看该作者
400楼快了。。。

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360
bargage| | 2015-5-28 15:16 | 只看该作者
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;

--模块功能:在曼彻斯特信号的上升沿产生时钟同步脉冲(近似的,模拟的,不是真正的脉冲)

Entity ER IS
PORT
(   
  R      : OUT STD_LOGIC;   
  MANIN  : IN  STD_LOGIC;
  CLK    : IN  STD_LOGIC   --曼彻斯特输入信号   
);
END ENTITY ER;

ARCHITECTURE ONE OF ER IS
SIGNAL MI : STD_LOGIC;
BEGIN
PROCESS(CLK)
BEGIN  
  IF CLK'EVENT AND CLK = '1' THEN
   IF MANIN = '1' OR MANIN = '0' THEN
    MI <= MANIN;
    R <= MI XOR MANIN;
   END IF;
  END IF;  
END PROCESS;
END ONE;

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