[cadence] 产生Cadence Allegro的第三方网表

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 楼主| gaochy1126 发表于 2022-6-30 15:43 | 显示全部楼层 |阅读模式
AD, ce

[color=rgb(51, 51, 51) !important]第一步,选择原理图根目录,执行菜单Tools→Creat Netlist,或者是点击菜单栏上的图标,调出产生网表的界面,如图3-74所示;

[color=rgb(51, 51, 51) !important]

[color=rgb(51, 51, 51) !important]图3-74 输出网表示意图

[color=rgb(51, 51, 51) !important]第二步,弹出的输出网表界面中选择Other选项,来输出第三方网表,如图3-75所示,在Formatters栏中选择orTelesis.dll选项,上面的Part Value栏需要用PCB Footprint来代替,不然会产生错误;

[color=rgb(51, 51, 51) !important]

[color=rgb(51, 51, 51) !important]图3-75 输出第三方网表设置示意图

[color=rgb(51, 51, 51) !important]第三步,按第二步所说的设置好参数以后,在下方的路径中可以选择网表存储的路径,如图3-75所示,默认路径是当前原理图所处的路径。点击确定按钮,即可输出第三方的网表文件,后缀是.NET的文件就是网表文件。


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