IO口功耗问题

发表于 2024-10-10 08:04

外部高电平的话会有灌电流输入哇

发表于 2024-10-14 21:00

关闭GPIO的上下拉电阻配置试试。外部输入端可以加高阻值的电阻做提拉。
现状估计是内部上下拉电阻导致的功耗吧。

发表于 2024-10-30 18:28

修改相关的GPIO口的配置，比如进入高组态，或者改成上拉电阻模式，应该能消除吧。

发表于 2024-10-30 20:31

设计为漏电流输入

发表于 2024-11-2 13:38

如果io端口的内部上拉或下拉电阻默认开启，并且低功耗模式下不需要io端口，则应将其关闭。

发表于 2024-11-2 19:09

使能内部下拉电阻，使io端口在无外部信号时保持低电平，从而降低漏电流。

发表于 2024-11-4 17:10

输入状态开启，内部上拉/下拉未开启

发表于 2024-11-6 13:27

连接外部下拉电阻也有助于稳定io端口电平并降低功耗。

发表于 2024-11-6 19:23

在设计阶段，应考虑外部干扰对IO端口功耗的影响，并采取适当的电磁兼容(emc)措施来降低干扰。

发表于 2024-11-8 18:07

如果外部电平高，就会有吸电流输入。

发表于 2024-11-10 09:29

修改相关gpio端口的配置，例如进入高配置，或者更改为上拉电阻模式，应该能够消除这种情况。

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