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新手请教一个VHDL程序的设计思路

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2542|1
 楼主| felixmj 发表于 2009-5-26 17:04 | 显示全部楼层 |阅读模式
VHDL程序, 时钟, 信号, 时钟信号, 同步复位
做一个时钟同步复位<br /><br />已知时钟信号输入，求一个复位输出，要求输出宽度可控&nbsp;范围在1ms~1000ms之间
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41dean 发表于 2009-5-29 10:01 | 显示全部楼层

做个定时就可以，好好看看书吧

  
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