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Verilog HDL的故事 流水操作和建模.pdf attachment
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FPGA论坛 雷北城 2021-8-16 0 4343 雷北城 2021-8-16 15:25
EDA实验设计七段数码管显示电路
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电子技术交流论坛 stopstopstop 2021-12-8 0 2027 stopstopstop 2021-12-8 22:03
ALWAYS语句
电路 ，verilog ，verilo ，组合 ，代码 ，综合
EDA 技术 gaochy1126 2023-5-29 0 9823 gaochy1126 2023-5-29 16:12
verilog基础——always、initial
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EDA 技术 gaochy1126 2023-11-30 0 10953 gaochy1126 2023-11-30 20:54
verilog 语法基础汇总
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EDA 技术 gaochy1126 2024-9-28 0 7274 gaochy1126 2024-9-28 16:06
Verilog中“=”和“<=”的区别
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EDA 技术 gaochy1126 2024-11-30 0 5126 gaochy1126 2024-11-30 21:33
请教verilog测试向量的写法
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EDA 技术 limee 2007-5-6 0 2578 limee 2007-5-6 13:51
生成高频率
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EDA 技术 吕萌 2007-9-18 0 1633 吕萌 2007-9-18 13:53
请教，Verilog预处理器VPP文件的使用
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EDA 技术 yan_rex 2007-10-15 0 2502 yan_rex 2007-10-15 10:02
请教：高手帮我看看程序（verilog）
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侃单片机论坛 huoxingshu 2007-8-10 0 1554 huoxingshu 2007-8-10 22:04
Verilog HDL简介
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FPGA论坛 星星之火红 2012-11-7 0 1643 星星之火红 2012-11-7 23:58
求解verilog
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ZLG fengyiyong 2012-12-6 0 1584 fengyiyong 2012-12-6 22:56
三段式verilog状态机，写好状态机还真不容易，求指导
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FPGA学习及设计中的注意事项
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ASIC 综合问题
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Verilog HDL语言在FPGA/CPLD开发中的应用
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德州仪器MCU FCCdsp 2017-7-16 0 597 FCCdsp 2017-7-16 16:17
Verilog中同步复位和异步复位比较
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FPGA论坛 zhangmangui 2017-12-16 0 1239 zhangmangui 2017-12-16 08:51
求助大神
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FPGA论坛 Old0wang 2020-3-24 0 432 Old0wang 2020-3-24 10:26
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[经验] Verilog 变量声明与数据类型二 attach_img
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嵌入式操作系统论坛 elephant00 2021-8-17 0 3288 elephant00 2021-8-17 11:20
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