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请教 $writememb 在 Verilog (Quartus II) 的正确使用方式
Quartus ，verilog ，WRITE ，mb ，指令
EDA 技术 youwenzh 2017-4-25 7 2379 gaochy1126 2017-4-30 22:49
如何用原理图设计方法给各个输入付初值~ attach_img
原理图 ，乘法器 ，加法器 ，ip核 ，verilog
FPGA论坛 18910748101 2017-4-13 0 647 18910748101 2017-4-13 18:53
Verilog的135个经典设计实例 attachment
verilog ，verilo ，AC
EDA 技术 usysm 2017-4-10 5 1466 gaochy1126 2020-10-27 17:22
基于至简设计法实现的PWM调制verilog attachment
verilog ，PWM调制 ，LED ，脉冲 ，AC
FPGA论坛 PKJIE吴 2017-3-24 2 586 teleagle 2017-3-25 23:18
新手准备开始学习FPGA，开发板的选择，dalao们进来给建议
FPGA ，开发板 ，硬件 ，verilog ，嵌入式
FPGA论坛 cross_stone 2017-3-17 6 1406 xiongbb 2017-5-8 07:37
verilog,遇到个问题，不知道怎么解释
verilog ，verilo
FPGA论坛 辉色天空 2017-3-5 3 972 LxiaoseI 2017-3-10 16:39
signed
verilog ，二进制 ，verilo ，仿真 ，仿真程序
EDA 技术 Proton—— 2017-3-2 0 701 Proton—— 2017-3-2 15:13
用verilog 写 u（k）=u（k-1）+error 怎么写 attach_img
verilog ，RS ，ST ，ge ，edge
FPGA论坛 18910748101 2017-1-12 10 1458 nethopper 2017-1-13 15:20
verilog 写的串口 在一个状态机里面，有一个寄存器无法执... attach_img
verilog ，串口 ，寄存器 ，状态机 ，AC
FPGA论坛 ok407371195 2017-1-3 14 2318 littbi 2017-12-10 22:35
大神能帮忙写个最简单的vhdl或者verilog hdl程序吗
verilog ，VHDL ，EDA ，控制 ，流水灯
EDA 技术 张张张张崔 2016-12-23 4 1125 韩山童 2017-1-6 10:19
MATLAB滤波器设计！ attachment
matlab ，滤波器设计 ，verilog ，Verilog语言 ，verilo
平台与系统开发 lvyunhua 2016-12-17 4 1193 lvyunhua 2017-6-2 10:00
简单问题：FPGA设计输出一个1KHz的方波方法？
FPGA设计 ，kHz ，方波 ，verilog ，计数器
FPGA论坛 伍戈123 2016-11-26 2 1850 伍戈123 2016-11-27 11:22
下面的NCverilog tcl脚本内容求大神帮忙解释一下
tcl ，verilog ，脚本 ，TE ，SIM
EDA 技术 t851018986 2016-11-24 1 2240 gaochy1126 2016-11-25 22:03
下面的NCverilog tcl脚本内容求大神帮忙解释一下
tcl ，verilog ，脚本 ，TE ，SIM
FPGA论坛 t851018986 2016-11-24 0 1358 t851018986 2016-11-24 11:55
如何实现实现Verilog实现的硬件逻辑与soc联合开发
SOC ，verilog ，硬件 ，C语言 ，寄存器
FPGA论坛 muzili314 2016-10-25 2 794 feihufuture 2016-10-30 16:49
FPGA有什么好的进阶教程
FPGA ，verilog ，编程 ，verilog编程 ，verilo
FPGA论坛 编程好烦 2016-10-14 0 784 编程好烦 2016-10-14 16:46
自己用纯verilog 写的俄罗斯方块，有很多问题，求大神指导
verilog ，俄罗斯方块 ，ge ，ST ，edge
FPGA论坛 ynhp0428 2016-9-19 4 2748 xmdk 2016-10-7 19:04
Verilog-DS18B20-串口输出温度值 attachment
串口输出 ，温度 ，verilog ，DS18B20 ，控制
FPGA论坛 湖南飞哥 2016-9-14 1 2393 alex0321 2019-5-15 10:46
Verilog调用vhdl代码，参数传不进去！！！ attach_img
verilog ，VHDL ，HDL代码 ，AC ，Gen
FPGA论坛 robotouch 2016-9-13 3 1411 robotouch 2016-10-25 22:04
AXI总线Verilog实现
verilog ，总线 ，altera ，接收模块 ，总线通信
电子技术交流论坛 love-CCD 2016-10-9 1 1189 love-CCD 2016-10-9 14:52
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