bootloader的启动问题
2012-11-30 08:12
- FPGA论坛
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12# GoldSunMonkey
猴哥，我的顶层设计是逻辑（verilog），即ise调用软核，这样也行？目前本人没有全部 ...
2# zuphen
兄弟，是否查到相关资料，如果查到是否可与我分享下，我也遇到相关头痛问题。邮箱，qq：4115 ...
FPGA设计的安全性
2013-2-17 21:19
- FPGA论坛
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很好的帖子，收藏
FPGA输入管脚有输入阻抗的概念吗
2013-2-17 21:12
- 模拟技术论坛
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我做的xilinx是有电流和阻抗等参数说明的。输出驱动电流的大小与你时序约束有关，二阻抗可以自己设计。 ...
软核不运行，急
2013-1-15 12:24
- FPGA论坛
- 23
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在bootloader程序内加上中断跳转后，问题解决，
谢谢各位大侠指点
猴哥好眼力，我做硬件的，郁闷中……
感谢各位这么多天的关注，本人汇报下进度：
1、*。bin文件已经顺利下入到flash。
2、*。bin文件已经加载到 ...
3q
您好，请问下：是不是将正常运行时的elf文件转换成bin文件还是其他格式文件？用什么工具转换？怎么下载？ ...
您好，bit与bootloader.elf文件可以用edk生产，用impact生成MCS下载到flash内。但是正常运行的elf文件需 ...
5# 星星之火红
谢谢大侠回复。目前就是想将程序放在ddr3内，生成elf文件，然后线下载逻辑bit，再下载elf ...
6# GoldSunMonkey
谢谢大侠回复。目前就是想将程序放在ddr3内，生成elf文件，然后线下载逻辑bit，在下 ...
3# liugp25
3Q
自己顶起
带以太网软核的bootloader问题
2013-1-14 18:23
- FPGA论坛
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最后解决办法是在bootloader加上中断修改指令，程序可以运行，谢谢各位大家指点 ...
感谢各位这么多天的关注，本人汇报下进度：
1、*。bin文件已经顺利下入到flash。
2、*。bin文件已经加载到d ...
感谢各位大侠指导，先将目前得到的信息汇报下：
目前做的一个项目带有软核lwip程序，生产的elf较大，没法直 ...
xilinx FPGA加载程序是IO口是什么电平 能设置吗？
2015-3-27 19:41
- FPGA论坛
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k7d 支持1.2-3.3V，同时，由引脚CFGBVS_0设置在1.8V以上还是以下
一个关于microblaze连接SDRAM的问题
2013-3-14 20:12
- FPGA论坛
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现在都是AXI了
最好是建一个xilinx官方的开发板demo程序看看，很简单的
求救：下面的开关量输入电路，三个IN4148分别是什么作用？
2013-4-17 10:50
- 模拟技术论坛
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DI 11多余？就靠DI11传输的开关量的
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