分享一个教程，给力的很。MATLAB从入门到精通
2022-6-13 08:45
- 平台与系统开发
- 808
- 48923
留图又留种，薪水往上走！
MATLAB2017官方提供中文教程，我打包成PDF了
2024-6-24 08:56
- 平台与系统开发
- 945
- 85083
留图又留种，薪水往上走！
Python爬虫教程
2024-4-9 19:50
- 平台与系统开发
- 392
- 29107
......
【活动结束】学习国产Kungfu芯片知识，赢取大奖
1502885648
- 166
- 14008
帖子因隐私问题而隐藏
怎么约束逻辑在bank里面，求刺！
2016-1-26 20:26
- FPGA论坛
- 0
- 735
怎么约束逻辑在bank里面
是否fpga所有寄存器都需要复位，意义何在
2016-1-18 09:51
- FPGA论坛
- 2
- 1385
约在金秋9月！上传之星是你吗？
2016-1-19 15:36
- 活动专区
- 54
- 6732
请问ISE中fifo编译警告如何消除
2015-8-18 17:32
- FPGA论坛
- 0
- 1137
48位的数比较大小如何优化
2015-6-11 08:55
- FPGA论坛
- 6
- 1305
Kinetis系统时钟说明之中篇（中文文档）
2019-1-11 15:13
- 恩智浦MCU论坛
- 935
- 49087
verilog使用规范
2015-6-9 10:51
- FPGA论坛
- 3
- 1001
放一些我 iCore2 ARM / FPGA 双核心板的资料,独家资料 高清大图
2024-2-22 08:16
- FPGA论坛
- 398
- 54132
FPGA实战演练逻辑篇28：USB和UART串口子板设计概述
2015-5-29 10:20
- FPGA论坛
- 1
- 900
verilog快速掌握之程序设计
2015-5-29 10:19
- FPGA论坛
- 2
- 886
晒晒新做的CYCLONE IV核心板 EP4CE15 共享原理图和测试程序
2024-8-9 09:59
- FPGA论坛
- 1494
- 145785
FPGA实战演练逻辑篇29：CH376之USB电路设计
2015-5-29 10:17
- FPGA论坛
- 1
- 1336
怎样将模拟信号解调成数字信号，用VerilogHDL实现
2015-5-29 10:08
- FPGA论坛
- 3
- 1369
调试一个UART程序，用verilogHDL写的
2015-9-3 09:23
- FPGA论坛
- 4
- 1533
怎么样才能摆脱fpga工具的束缚？？
2015-5-29 09:24
- FPGA论坛
- 3
- 846
2
3
近期访客