TMS320VC5409A的时序问题，谢谢了
2013-9-30 09:02
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这张图看，貌似两个沿都可以采！还有一般采数都是用沿的！
用CLKOUT的下降沿采数据啊！
QuartusII 12.0 发布 , 含和谐文件
2020-9-2 14:40
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多谢楼主
XILINX 的 ISE ，怎么在原理图里将输入和输出直接连接起来？
2013-9-25 18:53
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加个buffer试试
vivado的综合与实现策略怎样设置？
2013-9-17 21:30
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帮顶下，正想用vivado，貌似界面和planahead挺像？ISE貌似也支持7系列。
放一些我 iCore2 ARM / FPGA 双核心板的资料,独家资料 高清大图
2024-2-22 08:16
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看看哦
xilinx官方例程问题
2015-4-26 16:52
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近日在xilinx官网下载了xapp869例程，需要使用ise自带的xilperl处理例程中pl文件，用来生成示例工程， ...
哪位大哥给个synplify pro 9.6.2
2013-1-17 21:54
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xilinx FPGA加载程序是IO口是什么电平 能设置吗？
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FPGA设计的基本原则、技巧与时序电路设计
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chipscope 抓的信号相互乱串怎么回事
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QUARTUS II 13.0 有license噢
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