打印
[Actel FPGA]

[求助]

[复制链接]
1078|3
手机看帖
扫描二维码
随时随地手机跟帖
沙发
手写识别|  楼主 | 2010-4-23 23:01 | 只看该作者
出现Error parsing XML file D:\my documents\Fpga临时文件\led\stimulus\led.hpj

使用特权

评论回复
板凳
手写识别|  楼主 | 2010-4-23 23:02 | 只看该作者
HDL程序为:

// First.v

module LED(
               clk-48M,         
               RSTn,      
               LED      
          );
input       clk48M;
input       RSTn;
output [3:0]        LED;
reg    [3:0]        LED;
reg    [22:0]       cout;
always@(posedge clk48M or negedge RSTn)
begin
        if(!RSTn)        
        begin
                LED<=4'h8;  
        count<<=23'h0;      
      end
      else
      begin
      count<=count+1;
      if(count==23'hff_ff_ff)
      begin
            LED<=LED>>1;   
            count<=0;
            if(LED==4'h0)   
            LED<=4'h8;
        end
    end
end
endmodule

使用特权

评论回复
地板
思行合一| | 2010-4-27 19:59 | 只看该作者
工程文件不能有中文路径和空格

使用特权

评论回复
发新帖 我要提问
您需要登录后才可以回帖 登录 | 注册

本版积分规则

65

主题

361

帖子

1

粉丝