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以Spartan3E开讲Xilinx FPGA 内部结构（10.5更新，位于88楼）

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楼主: GoldSunMonkey
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121楼
GoldSunMonkey|  楼主 | 2011-11-23 13:47 | 只看该作者 回帖奖励 |倒序浏览
这个贴不能沉,顶起来哦.....
fu10 发表于 2011-11-23 11:05

谢谢啦。

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122楼
guoteng2000| | 2011-12-14 16:37 | 只看该作者
跟踪中

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123楼
GoldSunMonkey|  楼主 | 2011-12-14 23:20 | 只看该作者
:lol

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124楼
jakfens| | 2011-12-15 08:34 | 只看该作者
这个帖子又浮上来了

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125楼
受不了你| | 2011-12-17 21:55 | 只看该作者
话说是直接点击评分就算给分了吗？猴哥 2# GoldSunMonkey

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126楼
GoldSunMonkey|  楼主 | 2011-12-17 23:34 | 只看该作者
话说是直接点击评分就算给分了吗？猴哥 2# GoldSunMonkey
受不了你 发表于 2011-12-17 21:55

是呀。
发帖可以悬赏。都不影响你自己的

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127楼
allenhuang87| | 2011-12-18 10:35 | 只看该作者
感觉看不太懂

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128楼
allenhuang87| | 2011-12-18 10:36 | 只看该作者
感觉看不太懂

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129楼
nongfuxu| | 2011-12-18 11:30 | 只看该作者
学习中

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130楼
guoteng2000| | 2011-12-18 20:04 | 只看该作者
猴哥，请请教下你，怎么分辨，XILINX的IP CORE收费？ dual port block memory v6.3是否要钱？

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131楼
GoldSunMonkey|  楼主 | 2011-12-18 21:59 | 只看该作者
猴哥，请请教下你，怎么分辨，XILINX的IP CORE收费？ dual port block memory v6.3是否要钱？
guoteng2000 发表于 2011-12-18 20:04

后面没有锁标志的都是免费的。你说的那个IP是免费的。

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132楼
dljlpz| | 2012-7-17 11:44 | 只看该作者
8# GoldSunMonkey 这里我有两个问题：
有两个问题，关于IDDR,ODDR的，我看


1.1 在接收端fpga，对于到来的输入数据和随路时钟，用这个随路时钟采样输入数据，是不是要把随路时钟接到IDDR的时钟输入端呢？
1.2 出了上述的用途外，IDDR的用途还有，在fpga内部采用接口数据频率一半的时钟去采样数据，这个时候IDDR的两个相差180°的时钟频率是不是就是数据速率的一半？采样之后的两路数据D1，D2,是不是经过fpga内部处理之后，还要用ODDR组合之后输出才行？


谢谢！

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133楼
luyaoss| | 2012-11-14 11:26 | 只看该作者
猴哥出品，必看必顶~~慢慢消化~~

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134楼
GoldSunMonkey|  楼主 | 2012-11-14 18:43 | 只看该作者
猴哥出品，必看必顶~~慢慢消化~~
luyaoss 发表于 2012-11-14 11:26
谢谢。

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135楼
薇儿安蓝| | 2013-1-30 14:24 | 只看该作者
GoldSunMonkey 发表于 2011-5-31 22:17
输入、输出、三态。这三个IOB通道都可以实现DDR支持。

输出和三态通道可以实现ODDR2原语，这个原语的实现 ...

数据和时钟都经过IOB寄存器处理，具有相同的延迟特性，从而实现了所谓的源同步？？

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136楼
薇儿安蓝| | 2013-1-30 16:16 | 只看该作者
以后可以写一个《那些年我们一起追过的猴哥》

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137楼
hawksabre| | 2013-1-30 20:31 | 只看该作者
学习了   猴哥威武   谢谢猴哥   很不错哦   呵呵   顶一个   呵呵

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138楼
041030417| | 2013-3-7 13:10 | 只看该作者
好东西 谢谢

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139楼
GoldSunMonkey|  楼主 | 2013-3-7 15:08 | 只看该作者
041030417 发表于 2013-3-7 13:10
好东西 谢谢

感谢啊

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140楼
qin552011373| | 2013-3-7 20:04 | 只看该作者
很经典啊  猴哥自己写的吗？

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