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[DemoCode下载] PDMA功能进行内存到内存的数据传输

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 楼主| xuanhuanzi 发表于 2024-2-19 22:56 | 显示全部楼层 |阅读模式
ar, ST, pd, DMA, 内存, 数据传输
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  1. /******************************************************************************
    

  2.  * [url=home.php?mod=space&uid=288409]@file[/url]     main.c
    

  3.  * [url=home.php?mod=space&uid=895143]@version[/url]  V1.00
    

  4.  * $Revision: 4 $
    

  5.  * $Date: 18/07/13 4:20p $
    

  6.  * [url=home.php?mod=space&uid=247401]@brief[/url]    Use PDMA channel 1 to transfer data from memory to memory.
    

  7.  * @note
    

  8.  * SPDX-License-Identifier: Apache-2.0
    

  9.  * Copyright (C) 2018 Nuvoton Technology Corp. All rights reserved.
    

  10. *****************************************************************************/
    

  11. #include <stdio.h>
    

  12. #include "NuMicro.h"
    


  13. 

  14. #define PDMA_CH    1
    


  15. 

  16. /*---------------------------------------------------------------------------------------------------------*/
    

  17. /* Global variables                                                                                        */
    

  18. /*---------------------------------------------------------------------------------------------------------*/
    

  19. uint32_t PDMA_TEST_LENGTH = 64;
    

  20. #ifdef __ICCARM__
    

  21. #pragma data_alignment=4
    

  22. uint8_t au8SrcArray[256];
    

  23. uint8_t au8DestArray[256];
    

  24. #else
    

  25. __attribute__((aligned(4))) uint8_t au8SrcArray[256];
    

  26. __attribute__((aligned(4))) uint8_t au8DestArray[256];
    

  27. #endif
    

  28. uint32_t volatile g_u32IsTestOver = 0;
    


  29. 

  30. /**
    

  31.  * @brief       DMA IRQ
    

  32.  *
    

  33.  * @param       None
    

  34.  *
    

  35.  * [url=home.php?mod=space&uid=266161]@return[/url]      None
    

  36.  *
    

  37.  * [url=home.php?mod=space&uid=1543424]@Details[/url]     The DMA default IRQ, declared in startup_M031Series.s.
    

  38.  */
    

  39. void PDMA_IRQHandler(void)
    

  40. {
    

  41.     uint32_t status = PDMA_GET_INT_STATUS(PDMA);
    


  42. 

  43.     if (status & PDMA_INTSTS_ABTIF_Msk)   /* abort */
    

  44.     {
    

  45.         /* Check if channel 1 has abort error */
    

  46.         if (PDMA_GET_ABORT_STS(PDMA) & PDMA_ABTSTS_ABTIF1_Msk)
    

  47.             g_u32IsTestOver = 2;
    


  48. 

  49.         /* Clear abort flag of channel 1 */
    

  50.         PDMA_CLR_ABORT_FLAG(PDMA, PDMA_ABTSTS_ABTIF1_Msk);
    

  51.     }
    

  52.     else if (status & PDMA_INTSTS_TDIF_Msk)     /* done */
    

  53.     {
    

  54.         /* Check transmission of channel 1 has been transfer done */
    

  55.         if (PDMA_GET_TD_STS(PDMA) & PDMA_TDSTS_TDIF1_Msk)
    

  56.             g_u32IsTestOver = 1;
    


  57. 

  58.         /* Clear transfer done flag of channel 1 */
    

  59.         PDMA_CLR_TD_FLAG(PDMA, PDMA_TDSTS_TDIF1_Msk);
    

  60.     }
    

  61.     else
    

  62.         printf("unknown interrupt !!\n");
    

  63. }
    


  64. 

  65. void SYS_Init(void)
    

  66. {
    

  67.     /*---------------------------------------------------------------------------------------------------------*/
    

  68.     /* Init System Clock                                                                                       */
    

  69.     /*---------------------------------------------------------------------------------------------------------*/
    


  70. 

  71.     /* Unlock protected registers */
    

  72.     SYS_UnlockReg();
    


  73. 

  74.     /* Enable HIRC clock (Internal RC 48MHz) */
    

  75.     CLK->PWRCTL |= CLK_PWRCTL_HIRCEN_Msk;
    


  76. 

  77.     /* Wait for HIRC clock ready */
    

  78.     while((CLK->STATUS & CLK_STATUS_HIRCSTB_Msk) != CLK_STATUS_HIRCSTB_Msk);
    


  79. 

  80.     /* Select HCLK clock source as HIRC and HCLK source divider as 1 */
    

  81.     CLK->CLKSEL0 = (CLK->CLKSEL0 & (~CLK_CLKSEL0_HCLKSEL_Msk)) | CLK_CLKSEL0_HCLKSEL_HIRC;
    

  82.     CLK->CLKDIV0 = (CLK->CLKDIV0 & (~CLK_CLKDIV0_HCLKDIV_Msk)) | CLK_CLKDIV0_HCLK(1);
    


  83. 

  84.     /* Enable UART0 clock */
    

  85.     CLK->APBCLK0 |= CLK_APBCLK0_UART0CKEN_Msk;
    


  86. 

  87.     /* PDMA Clock Enable */
    

  88.     CLK->AHBCLK |= CLK_AHBCLK_PDMACKEN_Msk;
    


  89. 

  90.     /* Switch UART0 clock source to HIRC and UART0 clock divider as 1 */
    

  91.     CLK->CLKSEL1 = (CLK->CLKSEL1 & (~CLK_CLKSEL1_UART0SEL_Msk)) | CLK_CLKSEL1_UART0SEL_HIRC;
    

  92.     CLK->CLKDIV0 = (CLK->CLKDIV0 & (~CLK_CLKDIV0_UART0DIV_Msk)) | CLK_CLKDIV0_UART0(1);
    


  93. 

  94.     /* Update System Core Clock */
    

  95.     /* User can use SystemCoreClockUpdate() to calculate SystemCoreClock and cyclesPerUs automatically. */
    

  96.     SystemCoreClockUpdate();
    


  97. 

  98.     /*---------------------------------------------------------------------------------------------------------*/
    

  99.     /* Init I/O Multi-function                                                                                 */
    

  100.     /*---------------------------------------------------------------------------------------------------------*/
    

  101.     /* Set PB multi-function pins for UART0 RXD=PB.12 and TXD=PB.13 */
    

  102.     SYS->GPB_MFPH = (SYS->GPB_MFPH & ~(SYS_GPB_MFPH_PB12MFP_Msk | SYS_GPB_MFPH_PB13MFP_Msk)) |
    

  103.                     (SYS_GPB_MFPH_PB12MFP_UART0_RXD | SYS_GPB_MFPH_PB13MFP_UART0_TXD);
    


  104. 

  105.     /* Lock protected registers */
    

  106.     SYS_LockReg();
    

  107. }
    


  108. 

  109. void UART0_Init(void)
    

  110. {
    

  111.     /*---------------------------------------------------------------------------------------------------------*/
    

  112.     /* Init UART                                                                                               */
    

  113.     /*---------------------------------------------------------------------------------------------------------*/
    

  114.     /* Reset UART IP */
    

  115.     SYS->IPRST1 |=  SYS_IPRST1_UART0RST_Msk;
    

  116.     SYS->IPRST1 &= ~SYS_IPRST1_UART0RST_Msk;
    


  117. 

  118.     /* Configure UART0 and set UART0 Baudrate */
    

  119.     UART0->BAUD = UART_BAUD_MODE2 | UART_BAUD_MODE2_DIVIDER(__HIRC, 115200);
    

  120.     UART0->LINE = UART_WORD_LEN_8 | UART_PARITY_NONE | UART_STOP_BIT_1;
    

  121. }
    


  122. 

  123. int main()
    

  124. {
    

  125.     SYS_Init();
    


  126. 

  127.     /* Init UART0 to 115200-8n1 for print message */
    

  128.     UART0_Init();
    


  129. 

  130.     printf("\n\nCPU [url=home.php?mod=space&uid=72445]@[/url] %dHz\n", SystemCoreClock);
    

  131.     printf("+------------------------------------------------------+ \n");
    

  132.     printf("|    PDMA Memory to Memory Driver Sample Code          | \n");
    

  133.     printf("+------------------------------------------------------+ \n");
    


  134. 

  135.     /*------------------------------------------------------------------------------------------------------
    


  136. 

  137.                          au8SrcArray                         au8DestArray
    

  138.                          ---------------------------   -->   ---------------------------
    

  139.                        /| [0]  | [1]  |  [2] |  [3] |       | [0]  | [1]  |  [2] |  [3] |\
    

  140.                         |      |      |      |      |       |      |      |      |      |
    

  141.        PDMA_TEST_LENGTH |            ...            |       |            ...            | PDMA_TEST_LENGTH
    

  142.                         |      |      |      |      |       |      |      |      |      |
    

  143.                        \| [60] | [61] | [62] | [63] |       | [60] | [61] | [62] | [63] |/
    

  144.                          ---------------------------         ---------------------------
    

  145.                          \                         /         \                         /
    

  146.                                32bits(one word)                     32bits(one word)
    


  147. 

  148.       PDMA transfer configuration:
    


  149. 

  150.         Channel = 1
    

  151.         Operation mode = basic mode
    

  152.         Request source = PDMA_MEM(memory to memory)
    

  153.         transfer done and table empty interrupt = enable
    


  154. 

  155.         Transfer count = PDMA_TEST_LENGTH
    

  156.         Transfer width = 32 bits(one word)
    

  157.         Source address = au8SrcArray
    

  158.         Source address increment size = 32 bits(one word)
    

  159.         Destination address = au8DestArray
    

  160.         Destination address increment size = 32 bits(one word)
    

  161.         Transfer type = burst transfer
    


  162. 

  163.         Total transfer length = PDMA_TEST_LENGTH * 32 bits
    

  164.     ------------------------------------------------------------------------------------------------------*/
    


  165. 

  166.     /* Open Channel 1 */
    

  167.     PDMA->CHCTL |= (1 << PDMA_CH);
    


  168. 

  169.     /* Transfer configuration of Channel 1 */
    

  170.     PDMA->DSCT[PDMA_CH].CTL = ((PDMA_TEST_LENGTH - 1) << PDMA_DSCT_CTL_TXCNT_Pos) | /* Transfer count is PDMA_TEST_LENGTH */ \
    

  171.                               PDMA_WIDTH_32 |  /* Transfer width is 32 bits(one word) */ \
    

  172.                               PDMA_SAR_INC |   /* Source increment size is 32 bits(one word) */ \
    

  173.                               PDMA_DAR_INC |   /* Destination increment size is 32 bits(one word) */ \
    

  174.                               PDMA_REQ_BURST | /* Transfer type is burst transfer type */ \
    

  175.                               PDMA_BURST_4 |   /* Burst size is 4. No effect in single transfer type */ \
    

  176.                               PDMA_OP_BASIC;   /* Operation mode is basic mode */
    


  177. 

  178.     /* Configure source address */
    

  179.     PDMA->DSCT[PDMA_CH].SA = (uint32_t)au8SrcArray;
    


  180. 

  181.     /* Configure destination address */
    

  182.     PDMA->DSCT[PDMA_CH].DA = (uint32_t)au8DestArray;
    


  183. 

  184.     /* Configure PDMA channel 1 as memory to memory transfer */
    

  185.     PDMA->REQSEL0_3 = (PDMA->REQSEL0_3 & ~PDMA_REQSEL0_3_REQSRC1_Msk) | (PDMA_MEM << PDMA_REQSEL0_3_REQSRC1_Pos);
    


  186. 

  187.     /* Enable interrupt */
    

  188.     PDMA->INTEN |= (1 << PDMA_CH);
    


  189. 

  190.     /* Enable NVIC for PDMA */
    

  191.     NVIC_EnableIRQ(PDMA_IRQn);
    


  192. 

  193.     g_u32IsTestOver = 0;
    


  194. 

  195.     /* Generate a software request to trigger transfer with PDMA channel 1  */
    

  196.     PDMA->SWREQ = (1 << PDMA_CH);
    


  197. 

  198.     /* Waiting for transfer done */
    

  199.     while (g_u32IsTestOver == 0);
    


  200. 

  201.     /* Check transfer result */
    

  202.     if (g_u32IsTestOver == 1)
    

  203.         printf("test done...\n");
    

  204.     else if (g_u32IsTestOver == 2)
    

  205.         printf("target abort...\n");
    


  206. 

  207.     /* Close channel 1 */
    

  208.     PDMA->CHCTL = 0;
    


  209. 

  210.     while (1);
    


  211. 

  212. }
    


  213. 

  214. /*** (C) COPYRIGHT 2018 Nuvoton Technology Corp. ***/


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 楼主| xuanhuanzi 发表于 2024-2-19 22:56 | 显示全部楼层
初始化设置：
启用 HIRC（High Internal RC，内部高速振荡器）作为系统时钟源，并等待 HIRC 就绪。
将 UART0 时钟源设置为 HIRC，并配置波特率为 115200。
启用 UART0 和 PDMA 的时钟。
配置 PB12 和 PB13 为 UART0 的 RXD 和 TXD。
PDMA 中断处理函数：
定义了一个 PDMA_IRQHandler() 函数，用于处理 PDMA 中断。当数据传输完成或发生异常时，会触发中断，根据中断状态来更新相应的标志位。
主函数：
初始化系统和 UART0。
配置 PDMA 通道 1 的传输设置：
设置传输计数为 PDMA_TEST_LENGTH（64）。
设置传输宽度为 32 位（一个字）。
源地址和目的地址的增量大小均为 32 位。
传输类型为 burst transfer。
将源地址和目的地址配置为对应的数组 au8SrcArray 和 au8DestArray。
将 PDMA 请求源设置为内存到内存传输。
启用 PDMA 通道 1 的中断。
通过软件触发 PDMA 通道 1 的传输。
等待传输完成，并根据 g_u32IsTestOver 的值来判断传输是否成功或是否发生异常。
最后关闭 PDMA 通道 1，程序进入无限循环。
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 楼主| xuanhuanzi 发表于 2024-2-19 22:57 | 显示全部楼层
在这段代码中，PDMA 负责将 au8SrcArray 中的数据传输到 au8DestArray 中，传输过程中可以处理中断事件，以便及时处理传输完成或异常情况。
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