[verilog] Verilog不能合成MOS开关门原语

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 楼主| 平漂流 发表于 2017-6-3 15:59 | 显示全部楼层 |阅读模式
如图,在书上看到的一个小例程,然后用quartusii V14.1对其进行综合,显示Verilog不能合成MOS开关门原语。这段代码是在康华光的第五版的数电上看到的啊,为什么不能综合?

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