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alsort 发表于 2013-7-2 23:55 用鉴相器加后级电路调节
hyh791001 发表于 2013-7-3 20:22 你的意思就是锁相环电路获得的时钟信息相位是不同的,必须使用后级电路调整对吗?有相关的资料吗?谢谢 ...
GavinZ 发表于 2013-7-3 21:38 锁相环就是要锁定相位,所以相位是相同的。
路过打酱油。。 发表于 2013-7-4 13:06 “锁定相位”不等于“相位相同”,一般只能说相位差不变(自然是同频)。 ...
GavinZ 发表于 2013-7-4 13:23 因为我只用过将相位误差锁定为0的PLL,你能给我们举个你使用过的相位误差不为0的PLL芯片吗? ...
coody 发表于 2013-7-4 14:27 频率相同,有一定的相位差
hyh791001 发表于 2013-7-4 17:22 在数字接收电路中,假如获取的时钟与原来的数据的有相位差,后续电路是怎样解释数据的呢 ...
路过打酱油。。 发表于 2013-7-4 13:30 太多了.... 注意,我的用词——“一般只能说相位差不变”。
MCU52 发表于 2013-7-4 21:32 通过内部的鉴相器经环路滤波后得到与相位差有关的直流信号再放大后控制VCO ...
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