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[FPGA] 如何实现8倍频

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 楼主| bitshiyan 发表于 2014-5-13 20:13 | 显示全部楼层 |阅读模式
倍频, 时钟, hz, se
现在输入时钟为36.15MHz，想生成一个36.15*8=289.2Mhz的时钟，求教各路大神，ISE如何实现？

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ococ 发表于 2014-5-13 20:15 | 显示全部楼层
使用DCM或者PLL
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参与人数 1威望 +3 收起 理由
bitshiyan + 3

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 楼主| bitshiyan 发表于 2014-5-13 20:18 | 显示全部楼层
ococ 发表于 2014-5-13 20:15
使用DCM或者PLL

使用DCM 提示如图

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ococ 发表于 2014-5-13 20:20 | 显示全部楼层
选下面的手动输入，乘16，除2，或者乘32除4.
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 楼主| bitshiyan 发表于 2014-5-13 20:21 | 显示全部楼层
本帖最后由 bitshiyan 于 2014-5-13 20:23 编辑
ococ 发表于 2014-5-13 20:15
使用DCM或者PLL

使用DLL  

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ococ 发表于 2014-5-13 20:27 | 显示全部楼层
M=16，D=2，或者M=32,D=4.
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参与人数 1威望 +3 收起 理由
bitshiyan + 3 谢谢

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 楼主| bitshiyan 发表于 2014-5-13 20:31 | 显示全部楼层
本帖最后由 bitshiyan 于 2014-5-13 20:35 编辑
ococ 发表于 2014-5-13 20:27
M=16，D=2，或者M=32,D=4.

谢谢。太感谢您了。

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 楼主| bitshiyan 发表于 2014-5-15 13:27 | 显示全部楼层
无法结贴
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