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CPLD模块输出自定义
CPLD ，HDL ，hd ，VHDL ，时钟
FPGA论坛 DAEMONS 2017-5-2 1 670 DAEMONS 2017-5-15 17:45
仿真问题
仿真 ，HDL ，VHDL ，信号 ，信号发生器
德州仪器模拟论坛 wuhany 2017-4-22 9 461 wuhany 2017-4-22 23:50
nois2中预定义组件的HDL代码能否查看?
HDL ，代码 ，组件 ，HDL代码 ，hd
FPGA论坛 yangwenguan 2017-4-13 0 775 yangwenguan 2017-4-13 12:38
Cadence 16.5 Concept HDL原理图打包反标后电源、地网络显示为... attach_img
cadence ，CONCEPT ，HDL ，原理图 ，电源
电子技术交流论坛 文心雕龙7 2017-4-1 1 644 文心雕龙7 2017-4-1 01:21
Cadence 16.5 Concept HDL原理图反标后每个元件出现CDS_PART_NAME信息 attach_img
cadence ，CONCEPT ，HDL ，元件 ，原理图
电子技术交流论坛 文心雕龙7 2017-4-1 2 1307 文心雕龙7 2017-4-13 22:23
新手问题急求大神解答
HDL ，VHDL ，hd ，project ，Quartus
FPGA论坛 syh740008694 2017-3-11 6 957 奇异熊 2017-9-12 19:47
急求
HDL ，信号发生 ，音频信号 ，音频信号发生器 ，hdl语言
FPGA论坛 ccd203 2017-3-5 0 661 ccd203 2017-3-5 10:11
testbench的编写 attach_img
testbench ，编写 ，HDL ，VHDL ，hd
FPGA论坛 宝挖小子 2016-10-28 4 939 McuPlayer 2016-10-31 10:04
新手求教
HDL ，VHDL ，hd ，代码 ，电子
FPGA论坛 诺空199308 2016-8-25 6 786 诺空199308 2016-8-30 09:13
【锆石科技】关于 Verilog HDL 语言的一些关键问题解惑 attachment
verilog ，HDL ，阻塞赋值 ，AC ，IDE
FPGA论坛 锆石科技 2016-8-17 530 58464 publicpeople 2024-2-6 19:21
FPGA设计者的5项基本功
FPGA设计 ，仿真 ，hdl语言 ，HDL ，hd
FPGA论坛 嵌入式技术交流 2016-7-31 4 1107 admint 2016-9-1 15:27
例化选择特定的几位输出遇到的问题
Output ，TPU ，HDL ，TE ，TI
FPGA论坛 XLDZZ 2016-7-7 8 813 habc987 2016-7-12 22:34
quartus波形仿真时出现错误 attach_img
Quartus ，仿真 ，AC ，HDL ，verilog
FPGA论坛 JKM99 2016-7-2 1 1794 waiter 2016-7-3 20:51
HDLED-1驱动管理一体化开关电源
开关电源 ，HDL ，LED ，控制 ，电压
电源技术 huodidianqi 2016-7-1 0 672 huodidianqi 2016-7-1 14:38
工作FPGA无关，空余时间比较多，想自学FPGA,以后有机会从.....
FPGA ，HDL ，VHDL ，数字电路 ，电路
FPGA论坛 九龙城 2016-5-1 5 1069 matthewchan 2016-5-6 22:48
求助STR710的HDLC问题
HDL ，HDLC ，ST ，hd ，通信
ST MCU zhaoxintt 2016-4-24 0 803 zhaoxintt 2016-4-24 16:38
铁氧体磁环饱和问题
饱和 ，电流 ，HDL ，air ，hd
电源技术 joelxue_123 2016-4-19 1 1561 晓默儿 2016-4-20 20:43
Verilog 入门书籍
verilog ，FPGA ，HDL ，PGA ，VHDL
电子技术交流论坛 进击的ic 2016-3-28 4 1029 进击的ic 2016-3-29 11:27
编译是出现的问题？
编译 ，verilog ，verilo ，TI ，HDL
FPGA论坛 魔人布欧 2016-3-8 6 1430 魔人布欧 2016-3-29 19:24
MyHDL
HDL ，hd
FPGA论坛 魔人布欧 2015-12-21 0 595 魔人布欧 2015-12-21 16:04
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