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编码器多次正反转之后回到同一位置的值不同,怎么回事? FPGA论坛 peng61924 2013-1-16 3 2243 xjsxjtu 2013-1-17 20:40
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晒板子(DSP+CPLD)双层,急需猛批(图片已上传)
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问个入门问题:时序功能与逻辑功能的不同
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在DSP系统中为什么要使用CPLD?
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请问有谁用过AD9826吗
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请问,基于EDA的CPLD开发实例的书 DSP 技术 soya521 2008-1-30 3 2509 zwjgg 2009-9-18 21:45
用中颖以有一段时间,但还是有个小问题
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新手,咨询下,哪个FPGA最便宜?
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FPGA论坛 john78 2014-3-17 3 2068 ifpga 2014-3-19 10:05
EPM1270F100输入时钟的最大值为5V,可行吗 FPGA论坛 chenkai669 2014-6-27 3 1337 habc987 2014-7-3 22:57
现在CPLD都流行用什么工具来开发
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