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verilog if语句不执行问题
verilog ，代码 ，USB ，se ，ni ，dc
电子技术交流论坛 lvdaxian 2021-10-15 1 5240 lvdaxian 2021-10-19 11:11
FPGA关于verilog语言小数的计算问题？
国产芯片 ，FPGA ，verilog ，PGA
电子技术交流论坛 zhj11 2022-1-3 1 1611 qinxg 2022-1-6 10:07
求助：Verilog设计一个2位4输入最大数值检测电路
设计 ，检测电路 ，verilog ，代码 ，testbench ，TEST
FPGA论坛 小张001 2022-6-19 1 2679 mcu5i51 2022-6-20 07:45
Quartus II 中 Verilog 常见警告/错误汇总
Quartus ，UART ，verilo ，verilog
EDA 技术 gaochy1126 2023-2-28 1 7855 gaochy1126 2023-2-28 22:34
verilog的signed类型有哪些?
verilo ，verilog
EDA 技术 gaochy1126 2023-5-29 1 8333 gaochy1126 2023-5-29 14:35
VERILOG分配语句
verilo ，verilog
EDA 技术 gaochy1126 2023-5-29 1 9875 gaochy1126 2023-5-29 14:53
VERILOG实现异步FIFO
FIFO ，verilo ，verilog ，异步 ，异步FIFO
EDA 技术 gaochy1126 2023-5-29 1 9859 gaochy1126 2023-5-29 14:55
verilog并行语句有哪些
verilog ，verilo
EDA 技术 10299823 2024-9-29 1 19207 gaochy1126 2024-9-29 10:04
Verilog中的时间尺度与延迟
verilo ，verilog ，11 ，TI ，ig
EDA 技术 hanstin 2024-11-18 1 14224 咕咕呱呱孤寡 2024-11-30 08:48
请教：高手进来看看我的程序(verilog)
verilog ，RAM ，SRAM ，MCU ，TE
电子技术交流论坛 huoxingshu 2007-8-10 0 2556 huoxingshu 2007-8-10 22:02
急！急！急！心急如焚，请各位帮忙指点
verilo ，verilog ，HDL ，hd ，VerilogHDL
模拟技术论坛 yjg957104 2008-3-16 0 3653 yjg957104 2008-3-16 11:59
verilog问题
verilog ，verilo ，仿真 ，软件
电子技术交流论坛 四叶草 2007-6-19 0 2141 四叶草 2007-6-19 11:09
verilog HDL中wire和reg类型的区别 attach_img
Wire ，verilog ，HDL ，信号 ，端口 ，Input
EDA 技术 gaochy1126 2021-9-28 1 9185 gaochy1126 2021-9-28 13:45
Verilog硬件描述语言参考手册 attach_img
AC ，AD ，verilo ，verilog ，硬件描述语言
EDA 技术 gaochy1126 2022-1-27 1 2831 gaochy1126 2022-1-27 20:44
VERILOG寄存器
verilo ，verilog ，寄存器
EDA 技术 gaochy1126 2023-5-29 1 9820 gaochy1126 2023-5-29 14:58
Verilog几个这样的写法
verilo ，verilog
EDA 技术 gaochy1126 2023-8-31 1 12288 地瓜patch 2023-8-31 23:01
[资料] Verilog的135个经典设计实例 attachment
verilo ，verilog
技术资源专区 王栋春 2023-11-3 1 4336 thynet 2024-1-31 13:16
SPI调试总是不通
反馈 ，verilog ，verilo ，code ，调试 ，spi
电子技术交流论坛 entepino 2024-8-12 1 994 entepino 2024-9-4 18:35
Verilog语言与C语言的本质区别
C语言 ，Verilog语言 ，verilo ，verilog
EDA 技术 gaochy1126 2024-11-18 1 13367 咕咕呱呱孤寡 2024-11-28 08:48
求助FPGA状态机的条件always0和!always0是什么?（quartus II生成） attach_img
FPGA ，verilog ，Quartus ，状态机
FPGA论坛 泼墨染笛香 2025-1-7 1 12461 泼墨染笛香 2025-1-8 09:40
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