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FPGA论坛 dameihuaxia 2020-5-6 1 296 雷北城 2020-5-6 16:27
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FPGA论坛 贤达 2020-5-1 4 599 雷北城 2020-5-4 16:55
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FPGA论坛 ove学习使我快乐 2020-4-22 0 477 ove学习使我快乐 2020-4-22 09:11
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FPGA论坛 你好旅行者 2020-4-20 6 657 你好旅行者 2020-4-21 21:33
总结verilog中的几个小关键点
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FPGA论坛 一个拥抱 2020-4-4 0 410 一个拥抱 2020-4-4 17:23
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FPGA论坛 2287312853 2020-3-26 5 682 2287312853 2020-3-28 17:20
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FPGA论坛 雷北城 2020-3-24 3 715 雷北城 2020-3-26 15:12
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FPGA论坛 Old0wang 2020-3-24 0 395 Old0wang 2020-3-24 10:26
黑金 Verilog HDL那些事儿——建模篇、时序篇、整合篇 资料包 attachment
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FPGA论坛 hetao877 2020-3-12 46 46080 lsk211 2024-12-16 10:05
两套夏宇闻 verilog HLD 视频课程
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FPGA论坛 hetao877 2020-3-12 36 32570 cssfpga 2024-12-20 17:18
求问大神有没有关于IEEE 802.16e的编码器代码
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FPGA论坛 年轻的国王 2020-3-3 0 450 年轻的国王 2020-3-3 10:28
通过Verilog例子了解FPGA原型设计（书和源码） attachment
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FPGA论坛 GLL92 2019-11-18 3 709 路驹 2019-11-21 15:20
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电子技术交流论坛 mdy吴伟杰 2019-9-25 2 984 一麦 2019-9-25 13:59
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电子技术交流论坛 mdy吴伟杰 2019-9-24 0 433 mdy吴伟杰 2019-9-24 10:53
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FPGA论坛 mdy吴伟杰 2019-9-23 0 451 mdy吴伟杰 2019-9-23 11:11
verilog高手看看我的reg变量判断为啥第二种写法编译报错呢？ attach_img
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FPGA论坛 (⊙o⊙)你 2019-9-10 18 1372 (⊙o⊙)你 2021-5-10 15:20
Verilog HDL的基本语法 attachment
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FPGA论坛 mdy郭柏荣 2019-9-6 2 677 mdy郭柏荣 2019-10-18 15:31
采用Verilog HDL语言编写的多功能数字钟 attach_img
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FPGA论坛 GLL92 2019-8-31 1 818 zhangmangui 2019-8-31 23:43
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FPGA论坛 zszcn 2019-8-30 0 5599 无须终有iiiiii 2024-9-26 11:23
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FPGA论坛 2287312853 2019-11-25 4 935 2287312853 2019-11-26 08:55
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