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两套夏宇闻 verilog HLD 视频课程
verilog ，verilo ，HID ，IDE
FPGA论坛 hetao877 2020-3-12 40 38889 kpwu 2025-5-31 20:55
求问大神有没有关于IEEE 802.16e的编码器代码
IEEE ，代码 ，编码器 ，verilog ，verilo
FPGA论坛 年轻的国王 2020-3-3 0 608 年轻的国王 2020-3-3 10:28
占空比控制 attach_img
控制 ，FPGA ，HDL ，PGA ，verilog
FPGA论坛 2287312853 2019-11-25 4 1101 2287312853 2019-11-26 08:55
通过Verilog例子了解FPGA原型设计（书和源码） attachment
FPGA ，verilog ，源码 ，原型设计 ，AC
FPGA论坛 GLL92 2019-11-18 3 864 路驹 2019-11-21 15:20
FPGA是什么？ attachment
FPGA ，电路 ，verilo ，verilog ，VHDL
电子技术交流论坛 mdy吴伟杰 2019-9-25 2 1030 一麦 2019-9-25 13:59
 FPGA是什么 attachment
FPGA ，电路 ，verilo ，verilog ，VHDL
电子技术交流论坛 mdy吴伟杰 2019-9-24 0 503 mdy吴伟杰 2019-9-24 10:53
FPGA是什么？ attachment
FPGA ，电路 ，verilo ，verilog ，VHDL
FPGA论坛 mdy吴伟杰 2019-9-23 0 547 mdy吴伟杰 2019-9-23 11:11
verilog高手看看我的reg变量判断为啥第二种写法编译报错呢？ attach_img
verilog ，编译 ，ge ，RS ，ST
FPGA论坛 (⊙o⊙)你 2019-9-10 18 1733 (⊙o⊙)你 2021-5-10 15:20
Verilog HDL的基本语法 attachment
HDL ，verilog ，模型 ，电路 ，VerilogHDL
FPGA论坛 mdy郭柏荣 2019-9-6 2 802 mdy郭柏荣 2019-10-18 15:31
采用Verilog HDL语言编写的多功能数字钟 attach_img
verilog ，编写 ，hdl语言 ，多功能数字钟 ，Pay
FPGA论坛 GLL92 2019-8-31 1 976 zhangmangui 2019-8-31 23:43
自动售货机 Verilog 语言 状态机 FPGA 源代码 论文完整程序及... attach_img
FPGA ，verilog ，源代码 ，状态机 ，自动售货机
FPGA论坛 zszcn 2019-8-30 0 10068 无须终有iiiiii 2024-9-26 11:23
8位verilog加法器 attach_img
加法器 ，verilog ，信号 ，ni ，FPGA
FPGA论坛 mdy郭柏荣 2019-8-6 0 676 mdy郭柏荣 2019-8-6 14:47
串口发送
串口发送 ，verilog ，源码 ，频率计 ，verilo
FPGA论坛 fgc35159 2019-7-29 4 868 zhangmangui 2019-7-31 20:43
FPGA是什么？应用于哪方面？
FPGA ，电路 ，verilo ，verilog ，VHDL
FPGA论坛 mdy郭柏荣 2019-7-25 1 819 mdy郭柏荣 2019-7-25 16:29
第一个verilog的LED程序，仿真成功 attach_img
verilog ，仿真 ，LED程序 ，se ，TPU
FPGA论坛 springvirus 2019-7-2 7 2518 fzwwj95 2020-5-15 18:09
verilog编译错误
verilog ，编译 ，HDL ，ce ，DM
新手园地 fgc35159 2019-6-19 2 1785 ta1ent 2019-6-24 15:01
大神们，请问有关于超声全聚焦算法的Verilog的程序吗？我想参考一下。
verilog ，超声 ，FPGA ，PGA ，算法研究
FPGA论坛 qqqpppzzz 2019-5-30 0 808 qqqpppzzz 2019-5-30 09:48
如何编程设计三级流水线，计算样本方差 attach_img
编程 ，AC ，C语言 ，verilog ，编写
电子技术交流论坛 TDJC 2019-5-6 0 662 TDJC 2019-5-6 17:56
verilog 报错提示求助
verilog ，TE ，ST ，IO ，se
电子技术交流论坛 自由电子ERIC 2019-5-3 0 420 自由电子ERIC 2019-5-3 15:40
请问这是verilog的什么语法 attach_img
verilog ，AC ，Output ，TPU ，ce
FPGA论坛 ahhhhh 2019-5-16 4 952 thbdbdfbdfbd 2019-6-15 22:13
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