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verilog实现 floor, round 四舍五入 和 saturation 操作
ratio ，verilog ，round ，TE ，AD
FPGA论坛 yg99992 2019-2-19 2 14365 myl000 2024-5-19 14:39
找verilog 编写人员 北京海淀
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创业|外包|承接 兼职设计 2019-2-9 0 657 兼职设计 2019-2-9 14:39
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FPGA论坛 lanzhi112 2018-12-21 7 5472 城南123 2021-7-6 21:59
verilog用$fopen打不开txt文件
verilog ，pen ，RS ，代码 ，TE
FPGA论坛 nb533 2018-12-9 0 1392 nb533 2018-12-9 20:46
基于Verilog HDL的FIR数字滤波器设计与仿真 attachment
HDL ，verilog ，FIR数字滤波器 ，仿真 ，数字滤波器设计
德州仪器模拟论坛 Violin11 2018-12-5 1 560 Violin11 2018-12-5 16:26
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FPGA ，intel ，电路 ，编程 ，verilog
艾睿技术服务社区 yinwuqing110 2018-11-18 3 1387 nbnhnjnm 2019-1-28 14:23
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艾睿技术服务社区 kelly1989 2018-11-15 5 2419 zazszxzx 2019-1-28 14:43
明德扬FPGA连载课程第一阶段第三章VERILOG（2）
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FPGA论坛 guyu_1 2018-11-6 0 640 guyu_1 2018-11-6 09:20
明德扬FPGA连载课程第一阶段第三章VERILOG（1）
verilog ，FPGA ，仿真 ，电路 ，HDL
电子技术交流论坛 guyu_1 2018-11-5 0 643 guyu_1 2018-11-5 20:23
对分频器ip核的不理解 attach_img
ip核 ，分频器 ，verilog ，奇数分频 ，verilo
FPGA论坛 呱呱年 2018-10-21 4 1833 forrest11 2018-10-29 12:50
verilog请教 attach_img
verilog ，verilo ，TE
新手园地 欢乐的小僵尸 2018-10-17 2 519 零三翟邢止胃 2019-3-25 09:03
明德扬至简设计法--verilog的综合器和仿真器 attach_img
仿真器 ，verilog ，代码 ，电路 ，编写
FPGA论坛 明德扬fpga 2018-10-8 0 638 明德扬fpga 2018-10-8 15:54
用Verilog或VHDL写一段代码,实现消除一个glitch？
verilog ，VHDL ，代码 ，tc
新手园地 一片混沌 2018-9-11 0 131 一片混沌 2018-9-11 12:02
如何用VERILOG或VHDL写一段代码，实现10进制计数器？
verilog ，VHDL ，代码 ，进制计数器
新手园地 道子 2018-9-11 0 252 道子 2018-9-11 10:14
PL031 Verilog生成
verilog ，se ，信号 ，App ，verilog代码
新手园地 求关注啊 2018-9-9 0 183 求关注啊 2018-9-9 20:32
modelsim无法建立project
modelsim ，project ，library ，verilog ，win
FPGA论坛 VCrawford 2018-9-7 0 1345 VCrawford 2018-9-7 11:02
关于仿真软件modelsim无法建立工程
modelsim ，仿真软件 ，library ，project ，verilog
EDA 技术 VCrawford 2018-9-7 2 2836 gaochy1126 2018-10-7 12:05
VERILOG
verilog ，verilo
FPGA论坛 qqbacon1s 2018-9-7 3 819 蒋哈哈 2018-11-24 17:55
求电子书《Programming FPGAs_ Getting Started with Verilog》 attachment
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电子技术交流论坛 azsxdcfv 2018-11-27 3 687 friedrichwjs 2019-2-18 08:45
怎么区分哪些buffer/inverter是CTS插入的，哪些是原Verilog网表里的？
buffer ，INVERTER ，verilog ，verilo ，TE
新手园地 第十代火影 2018-9-10 0 268 第十代火影 2018-9-10 14:12
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