ADC/DAC 应用设计宝典——电子工程师必备（完全免费）
2012-3-19 15:31
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学习了，呵呵
求Verilog HDL程序
2012-3-19 18:39
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IDDR2 #(
.DDR_ALIGNMENT("NONE"), // Sets output alignment to "NONE", "C0" or "C1"
.INIT ...
如是xilinx的芯片用原语更方便，IDDR2，.v代码中直接例化。:lol
Lattice哪家代理商可提供为客户CPLD开发服务？
2012-3-23 15:48
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呵呵，lattice在上海有的
FPGA 时序分析（一）
2016-11-23 13:38
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理论都是一样，不同的是对软件的操作及对底层器件的了解.
由“组合电路描述与时序电路描述分开写”想到的
2012-3-21 14:07
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13# dong_dt
呵呵，看清楚了在回哈，我给的例子恰恰是反例，我可没说那个例子是推荐的例子。 ...
支持猴哥。:lol
嘻嘻，不敢同意你的说法，
1，难道你写完代码不仿真吗？（小型可能可以，复杂的还是需要的吧，至少功能仿真 ...
1，首先说下，你对赋值方式的应用有错，时序逻辑用什么方式，组合逻辑用什么方式需理解及分清楚。
2，例1－ ...
组合逻辑里可以出现移位运算符吗
2012-3-20 09:08
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嘻嘻，看的是功能仿真吧，
组合逻辑延时，不太好控。
建意用时序逻辑，组合逻辑容易出问题。
一个FPGA程序最高能跑多少M
2012-4-29 17:32
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能跑多快有几个因素：
1，所选的目标芯片的理论值，同样的代码，同样的设置在高等级的芯片上能跑到的最高工 ...
新手学习官方文档可行吗？quartus之后还需要学习什么？
2012-3-22 10:18
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软件只是一个工具，一到两个星期基本操作就很熟了。没有哪本书讲软件的使用会是最新软件的，从写书开始到出 ...
求助 EPM7128的JTAG脚能否当普通IO口用
2012-3-21 11:20
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你说的这个型号不是很了解。应该是不可以的，jtag用的都是专用IO，不属于任何一个bank。 ...
关于如何更好学习FPGA静态时序约束
2012-3-22 13:10
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嘻嘻，笑而不语。
记住是用处不大，不是没有用作。
没见到几家培训做的很好的。价是高的不得了，讲的东西 ...
呵呵，培训没有太大的用处，教的还是理论方面的一些东西，范范的而谈，FPGA的培训大都如此，费用一般而言都 ...
呵呵，很难找到一本专门讲时序方面的书，经验性的东西较多。
1，时序的理论就那么一点，本科的大二的数电都 ...
AD采样数据同步问题
2012-12-6 21:29
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如果不是同源就杯具了。同源的话还有办法
还有一个就是PCB布线时，AD出来的11位线是不是等长了？ ...
这坛怎么好久没有讨论过ACTEL的FPGA了
2012-3-22 10:11
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用的人少吧，呵呵，多数用的都是xilinx or altera
lattice都用的人不多，actel就更少了。 ...
流水线设计
2012-3-22 10:09
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so easy!
移位即可：
always @ ( posedge clk)
begin
if ( !rst_n ) a
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