Image
Image

cuianbin

+ 关注

粉丝 5     |     主题 86     |     回帖 439

来到这个论坛,乐于分享,好好学习!!
大家常用电路能否做到信手拈来?
2013-12-13 17:31
  • 模拟技术论坛
  • 35
  • 4730
  哈哈,握个手!  
工作五个月了,心里面有些想法。。。
2014-10-10 13:18
  • 新手园地
  • 79
  • 13944
  做够一年,然后再跳!我和你一样的经历!  
拜拜FPGA!
2013-11-14 15:01
  • FPGA论坛
  • 12
  • 2508
  您说的对!我以后要专心做硬件!  
  首先谢谢写了这么多,你说的很有道理,我仔细想了下,做硬件未必没有做FPGA有前途。 ...  
DDR2 突发读写遇到问题。
2017-10-18 15:29
  • FPGA论坛
  • 15
  • 4248
  突发读写64个32bit数据  
  嗯,暂时根据一个人提供的例程,可行了。  
  是的!单次读写搞定了,突发的问题不知道在哪  
四层板 QFN 封装IC 底部的 exposed PAD 怎么处理?
2013-7-30 18:10
  • 侃单片机论坛
  • 8
  • 4700
  做封装的时候,散热焊盘那块,让它裸露铜皮就行了吧。我要是四层板子的话,没有必要打过孔在上面吧。热风 ...  
  先在IC底部散热PAD涂一层薄薄的锡,然后压在PCB散热焊盘上,对着板子另一面用热风枪吹一会,是么?我这个 ...  
  对,手工焊接,芯片底部裸露的焊盘 要接地,我做封装的时候,让这部分不上绿油,焊接的时候 直接压在上 ...  
总结一下FPGA板的痛苦调试经历,顺便晒板
2015-9-5 21:10
  • FPGA论坛
  • 78
  • 15233
  LZ,你好,能否给点四层板FPGA 和DDR2 布线的经验呢?这个是Altium Designer 画的吗? ...  
源时钟和目的时钟为什么相差一个clock?
2013-7-12 19:31
  • FPGA论坛
  • 13
  • 1587
  这个源时钟与目的时钟 应该怎么解释才好  
  难道是我理解有问题?  
  Net FPGA_GCLK1 LOC = V10 | TNM_NET = sys_clk_pin; TIMESPEC TS_sys_clk_pin = PERIOD sys_clk_pin 500 ...  
spartan6做的多屏接接板卡,新鲜出炉,show下,大家评价下 :)
2013-7-10 22:37
  • FPGA论坛
  • 18
  • 2705
  板子用什么工具画的?  
有大神做过DDR2模型的Modelsim 仿真没有呢?
2013-6-24 10:57
  • FPGA论坛
  • 10
  • 4251
  也就是说chipescope 不能观察 DCM 时钟信号是吗? 我在cdc 文件中 添加了DCM的所有输出,结果在chipscope ...  
  谢谢!还有个问题我在chipescope ILA 中加入 DCM 输出的时钟信号,为啥 MAP 时就会报错? Place:1136 - ...  
  谢谢你!我再试一下。我现在直接用chipescope 去看信号了,modelsim 仿真起来好卡,占内存太大了。以后多 ...  
特权同学SD卡代码疑问begin end 中连续出现两个 if 如何分析?
2013-6-20 20:46
  • FPGA论坛
  • 25
  • 3523
  如果 是 if a>3        b=5      if a>5        c=4 语法上是否 ...  
Allegro 拉线问题
2013-5-25 13:42
  • PCB技术
  • 4
  • 2602
  嗯,定义了!定义快捷键后 必须重启软件才能生效!  
2
3
近期访客