准备做个数据压缩小模块，欢迎提供数据样本
2015-6-24 15:36
- 电子技术交流论坛
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现提供一些测试数据样本下载，内含解码程序，用于变电站的网络报文压缩
http://pan.baidu.com/share/link? ...
基于FPGA的高速实时数据采集存储系统
2013-2-25 15:35
- FPGA论坛
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这篇**，问题一大堆，完全是外行拼凑的。
看描述FPGA的那段话，完全是瞎扯，XC5VLX50，没有GTP，也没有PPC4 ...
关于spartan6的上的ddr3问题提示，希望后面的人可以避免
2015-4-28 09:44
- FPGA论坛
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补充一下，这个VREF是FPGA的IOBANK上的那个VREF,和电源芯片上的那个VREF不同。
...
ISE布线约束问题，很诡异……
2015-10-17 09:53
- FPGA论坛
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你注意看，仔细看
Net Ethernet_MAC_1_PHY_tx_data_pin LOC = C6 | IOSTANDARD = LVCMOS33 | DRIVE = 8; ...
高温FPGA [
2013-1-28 22:38
- FPGA论坛
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xilinx的Q系列都可以啊
朋友有800W想投入自动化行业，大家说说可投什么
2013-3-2 20:31
- 创业|外包|承接
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这东西我参与过，做了个伺服卡控制汽轮机的蒸汽量实现调速，才发电厂的汽轮机上做过实验，最终用上去了。 ...
做汽轮机的自动控制系统或其中某一部件，这一块相当的落后，东西又卖的死贵，不仅仅是国内。话又说回来，你 ...
DDR3的CLK和CLK#的端接问题
2013-1-29 11:37
- FPGA论坛
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DDR3的输入引脚有直流电平参考基准VTT，实际就是个比较器比较引脚电平和VTT的大小。
方法1是虚拟的中心点 ...
可用，但不等效，正确的做法是2
CPU的以太网接口可以直接连1×9光模块吗？
2013-1-30 23:39
- 通信技术
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这个只是用光模块通讯，但是没有使用以太网协议，不能上交换机的
不可以，1x9的光模块是100base-FX，符合ieee 802.3有可能只支持电网口，不支持光口 ...
ODDR2 的延时问题
2013-2-17 11:34
- FPGA论坛
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这个不是IODELAY的问题吧，你看A和B都是经过ODDR2的，按说ODDR2的输出延时应该是非常小的，在同一时钟驱动 ...
Xilinx推出多项20nm第一继续保持领先一代优势
2013-2-13 18:52
- FPGA论坛
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artix7系列还没见到，就开始准备8系列了啊
关于DDR设计的一个问题，急！！！！
2013-2-7 23:12
- FPGA论坛
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急也没有用，spartan3系列也是这个现象，一对IOB公用1个OCLK时钟和1个ICLK，spartan6还是老样。
virtex就不 ...
如何同时使用上升沿和下降沿！？
2013-2-18 08:24
- FPGA论坛
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使用IDDR或ODDR
cyclone iv gx芯片做PCI-E太费资源
2013-3-11 20:24
- FPGA论坛
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:lol spartan-3a那是相当皮实啊，我有几片怎么折腾都没有坏
一堆隔离芯片，堆料烧钱啊 ...
Help！！这段算法的FPGA 实现！
2013-3-13 08:37
- FPGA论坛
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这是算法设计的问题，用了多个除法，尽量把除法去掉。
除法是非常难缠的，别看在ARM上代码写起来简单，执行 ...
18000月薪该不该去
2013-3-22 17:12
- 职场生活
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如果你还在纠结这个问题的话，那就说明两个都不合适，如果你有足够的能力的话建议再找找。
拿到1万8还没有 ...
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