XILINX Rapidio 使用探讨---我又回来了，不信整不明白这IPcore
2016-3-30 09:25
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rapidio 没整明白。
现在这块真成了问题了，还没时间去弄，又要用！
我现在配好了DSP和FPGA IPcore的参数 ...
我现在配好了DSP和FPGA IPcore的参数，能把DSP的数传到 FPGA rapidio里面，可是该怎么把这个 FPGA rapidi ...
......
测试license说的是支持仿真的，为什么仿真Elaborating完了，就提示“simulation terminated ： the simulat ...
收到，谢谢指点，研究中user interface 。。这个“++rapidio核的接口，只有底层几对rx/tx差分接口，想实 ...
下图是rapido 核的verilog HDL代码目录
待解决的目标：实现DSP和FPGA通信。
1.DSP发送数据到FPGA rapidio ...
研究所最近搞项目DSP+fpga（高手给看看，谢谢了哈）
2018-3-19 17:32
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如何禁止综合器讲某个信号走BUFG
2013-10-30 21:04
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