请教一下，进程process中是不是不能有两个时钟沿？
2007-4-4 14:24
- EDA 技术
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最好不要有两个时钟沿.
初学这问一个关于MAX+PLUSS II软件的问题，望有心人回答
2007-4-20 23:45
- EDA 技术
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initial语句只是在仿真是才有用,下载到芯片中没有作用了.
如何提高VHDL？
2008-7-7 21:46
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要有项目做，有人带才行。
大家都来讨论一下新手怎么学习fpga
2024-11-27 09:18
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这个跟C C++不一样，一定要有开发板配合做实验。
多做实验才是学习的途径。有什么问题可以与一起学习交流 ...
关于FPGA图像采集，麻烦大家给点建议
2009-11-24 13:52
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这个FPGA这方面，主要是做FIFO和编码转化。
数字设计&verilog 每周一练（一 二）
2024-11-27 09:18
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我也给个题目：周期可控加减计数器。
FPGA学习步骤，我的体会
2013-6-17 22:10
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说的是好，可是真正能做的人没有几个。
还是好好练习，做实验才是重要的。
上面的几个方面，哪个方面都可以 ...
IP源码(verilog,vhdl)大赠送
2009-12-27 16:08
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当然有了，只是看你的有没有价值了。
关于verilog forever语句的疑惑
2009-12-3 22:26
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你要分清楚哪些是测试用的，哪些是能综合的设计的。
请教关于Verilog程序保密的方法
2009-12-1 15:09
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可以给网表，不过这个别人也不会要的。
个人好难做这方面的
请问一个CRC校验的问题
2009-12-6 07:27
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不是有公式吗。你套上去就行了。
FPGA 真的是本科生不能学习吗
2012-9-4 20:52
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一定可以学，只要肯花钱。
VHDL的相关资料文档
2011-1-19 21:13
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一些VHDL的相关文档，对想学习VHDL的网友应该有所帮助。
VHDL.Programming.by.Example
http://yunfile.com ...
VHDL文档资料一
2011-1-24 16:59
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推荐一本学习VHDL的书--《基于VHDL的FPGA和Nios II实例精炼》
2011-11-10 15:09
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《基于VHDL的FPGA与NIOS_II实例精炼》配套源代码与视频整理
2013-11-8 08:35
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