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Devere Hu E-mail: deverehu@comtech.com.cn Tel: 027-87568667 Mobile ：13545000634 Comtech (Wuhan), Xilinx FAE[设计心得] 昨天解决的一个问题
2011-10-10 22:48
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1. 先用示波器点了一下端口的信号。这种情况，个人觉得，一定要用示波器看信号，逻辑分析仪的用处一般不大
...
[设计心得]在spartan3中例化EDK的BSB
2011-10-9 22:50
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到时候，我把自己的帖子，觉得有用的就做成一个PDF文档，分类做好发上
[设计心得]全局复位的处理
2011-10-10 22:51
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有没有人知道两者之间的区别？ 明天更新我的想法
wire sysRst_n;
wire sysRstTempWire;
assign sysRstTempWire = dcm0Lock & sysRstIn_n ;
BUFG clk ...
//第二种复位使用线与的形式然后上BUFG
//dcm signal
wire dcmTempClk,clk01x,sysClk,dcm0Lock;
reg dcm0Rst;
//reset for dcm
...
[设计心得]Xilinx的小知识卡片
2011-10-10 22:41
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13 EDK例化MPMC的时候，如果选择多个端口XCL,PLB,SDMA等，如果需要将接口引入到处理器外部，选择VIEW/Resto ...
13 S6时钟资源
S6系列的芯片提供16个全局时钟网络，并提供40个区域时钟，用于ISERDES和OSERDES串并转化或 ...
12 S6小于45的芯片只有2个CMT(clock management tile)，大于等于45的有4个CMT，每个CMT有两个DCM和一个PLL ...
10 一般加入一个外设后，需要将其挂到相应的PLB总线上才能分配地址，和别的地址统一； ...
9 EDK12.1中有些DDR2的型号是不支持的，但是在MPMC中可以选择，编译的时候会出错，一般表现为CAS的延迟 ...
8 ISERDES和OSERDES只能支持Vertex4,5,6系列和spartan6；spartan3a/N系列不支持；但是xilinx官方网站上 ...
7 每一款XILINX的FPGA芯片的时钟管理CMT,DCM,PLL都可以重配置，在例化的时候，注意选择方式。Spartan中 ...
6 spartan6两侧的MCB在EDK中可以公用一个PLL产生的时钟，在ISE中应该也可以；
5 modusim的SE版本比XE版本好，XE每次升级都必须到官网上下载，不像SE可以直接编译。 ...
4 Spartan3-AN系列M0-2需要上拉的时候，上拉电阻1K作用，电阻值过大，导致电平在1.5V左右，FPGA可能认为 ...
2 Spartan6目前不支持自动产生DDR/DDR2/DDR3的软核，MIG和EDK里面的MPMC都不支持；但是可以手动产生，然 ...
大家谈谈和FPGA的第一次亲密接触吧
2011-11-2 18:59
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最初就是VHDL的
为软件工 程师揭开 FPGA 的神 秘面纱
2011-10-12 17:24
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:)
FPGA设计的常用技巧整理
2011-11-8 09:35
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