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STM32F10xx时钟系统框图:时钟是整个系统的脉搏

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楼主
STM32|  楼主 | 2007-12-26 22:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
下图是STM32F10xx时钟系统的框图,通过这个图可以一目了然地看到各个部件时钟产生的路径,还可以很方便地计算出各部分的时钟频率。

STM32的四个时钟源(HSI、HSE、LSI和LSE)也在图中标出;图中间的时钟监视系统(CSS)是在很多ST7的单片机中就出现的安全设置。

图的右边,输出定时器时钟之前有一个乘法器,它的操作不是由程序控制的,是由硬件根据前一级的APB预分频器的输出自动选择,当APB预分频器的分频因子为1时,这个乘法器无作用;当APB预分频器的分频因子大于1时,这个乘法器做倍频操作,即将APB预分频器输出的频率乘2,这样可以保证定时器可以得到最高的72MHz时钟脉冲。
沙发
hotpower| | 2007-12-26 23:01 | 只看该作者

不错~~~没时间分析...请香主说有无外振停振自动切换为RC功能

谢谢指教~~~

俺正在预习~~~

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板凳
grant_jx| | 2007-12-26 23:45 | 只看该作者

我也偷偷懒吧,如下例子

记得启动CSS前要:
  /* Enable Clock Security System(CSS) */
  RCC_ClockSecuritySystemCmd(ENABLE);



代码放到RCC_IRQHandler中断中,

 /* This interrupt is generated when HSE clock fails */
  if (RCC_GetITStatus(RCC_IT_CSS) != RESET)
  {
    /* At this stage: HSE, PLL are disabled (but no change on PLL config) and HSI is selected as system clock source */

    /* Enable HSE */
    RCC_HSEConfig(RCC_HSE_ON);

    /* Enable HSE Ready interrupt */
    RCC_ITConfig(RCC_IT_HSERDY, ENABLE);

    /* Enable PLL Ready interrupt */
    RCC_ITConfig(RCC_IT_PLLRDY, ENABLE);

    /* Clear Clock Security System interrupt pending bit */
    RCC_ClearITPendingBit(RCC_IT_CSS);

    /* Once HSE clock recover, the HSERDY interrupt is generated and in the RCC ISR routine the system clock will be reconfigured to its previous state (before HSE clock failure) */
  }


hotpower在另外的帖子里问得需要指示,可以通过这个函数RCC_GetITStatus(RCC_IT_CSS)得到。上面的中断服务程序作用在最后的说明有解释。

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地板
hq_y| | 2007-12-27 12:05 | 只看该作者

嗯有了这个机制,就可以有效地控制外围的控制电路

不让晶振停振的时候,出现不可控制的损失;

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5
benladn911| | 2007-12-27 13:08 | 只看该作者

呵呵,谢谢,很好的图。

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6
hotpower| | 2007-12-27 13:12 | 只看该作者

4楼的教导让人心里有底了许多~~~下午继续学习~~~

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7
kingpoo| | 2007-12-27 21:22 | 只看该作者

没看明白,既然自动切换,为何还要中断中进行设置?

没看明白,既然自动切换,为何还要中断中进行设置?

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8
STM32|  楼主 | 2007-12-27 21:28 | 只看该作者

LS是不是看串行了,哪里说要中断中进行设置?

3楼和4楼都是说,Enable CSS后,在HSE发生故障时CSS会自动切换时钟源并产生中断,这样可以通知软件进行紧急处理。

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9
kingpoo| | 2007-12-28 08:38 | 只看该作者

抱歉,没看清楚!

很巧,ZLG上面也有一个讨论这个的

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10
handerson| | 2007-12-28 12:35 | 只看该作者

哈哈,以前就有人问过这个问题

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