5509的存储器、系统启动与中断、时钟

• void INTconfig()  
• {  
•         /* Temporarily disable all maskable interrupts */  
•   
•         IRQ_setVecs((Uint32)(&VECSTART));  
•   
•         /* Temporarily disable all maskable interrupts */  
•   
•         old_intm = IRQ_globalDisable();  
•   
•         /* Get Event Id associated with External INT1(8019), for use with */  
•   
•         eventId0 = IRQ_EVT_INT0;  
•   
•         /* Clear any pending INT1 interrupts */  
•   
•         IRQ_clear(eventId0);  
•   
•         /* Place interrupt service routine address at */  
•   
•         /* associated vector location */  
•   
•         IRQ_plug(eventId0,&int1);  
•   
•         /* Enable INT1(8019) interrupt */  
•   
•         IRQ_enable(eventId0);   
•   
•         /* Enable all maskable interrupts */  
•   
•         IRQ_globalEnable();      
• }  
  

程序：

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• main()  
• {  
•         /*初始化CSL库*/  
•         CSL_init();  
•         /*EMIF为全EMIF接口*/  
•         CHIP_RSET(XBSR,0x0a01);  
•         /*设置系统的运行速度为144MHz*/  
•         PLL_config(&myConfig);   
•         //设置并使能5509A芯片的INT0中断(EXINT中断)  
•         INTconfig();  
•         while(1);  
• }  
  

[url=][/url]

main(){        /*初始化CSL库*/        CSL_init();        /*EMIF为全EMIF接口*/        CHIP_RSET(XBSR,0x0a01);        /*设置系统的运行速度为144MHz*/        PLL_config(&myConfig);          //设置并使能5509A芯片的INT0中断(EXINT中断)        INTconfig();        while(1);}

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• //External INT0(EXINT)中断处理函数  
• interrupt void int1()  
• {  
•     printf("EXINT ouccers\n");  
• }  
  

[url=][/url]

//External INT0(EXINT)中断处理函数interrupt void int1(){    printf("EXINT ouccers\n");}

设置好IVPD（IVPH）后，还需要在cmd文件里重新指明中断向量表存放在相应的位置。

参考http://www.eptw.com/bbs/viewthread.php?tid=2619

IVPD和IVPH的赋值和.CMD文件中的存储器定位有关，BOOT    origin=8000h,length=00100h vectors:>BOOT，如上面定位是80H，则初始化IVPD和IVPH的值时就是MOV #0x80,mmap(IVPD)。

三、TMS320VC5509A的时钟（PLL）

1. 时钟电路

TMS320VC5509A的内部振荡器复位时为有效。内部振荡器需要外部晶体支持，连接到X1和X2/CLKIN引脚。如果不用内部振荡器，外部时钟连接到X2/CLKIN引脚，X1引脚悬空。当内部振荡器作为时钟源输入到PLLs时，振荡器时钟可以倍频或分频成为CPU时钟、USB时钟等。

电路连接图如下图所示：

各电阻电容值参考下表：

2. PPLs

1) Clock Generation in Bypass Mode (DPLL Disabled)

通过时钟模式设置寄存器的BYPASS_DIV位可以设置DPLL失效。

2) Clock Generation in Lock Mode (DPLL Synthesis Enabled)

The frequency of the reference clock provided at the X2/CLKIN pin can be multiplied by a synthesis factor of N to generate the internal CPU clock cycle. The synthesis factor is determined by:

where: M = the multiply factor set in the PLL_MULT field of the clock mode register

D = the divide factor set in the PLL_DIV field of the clock mode register

Valid values for M are (multiply by) 2 to 31. Valid values for DL are (divide by) 1, 2, 3, and 4.