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楼主
iampeter|  楼主 | 2011-9-5 17:54 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
TE, ce, se, AC, AN
ERROR:Place:543 - This design does not fit into the number of slices available in this device due to the complexity of
   the design and/or constraints.
ERROR:Place:120 - There were not enough sites to place all selected components.
   Some of these failures can be circumvented by using an alternate algorithm (though it may take longer run time). If
   you would like to enable this algorithm please set the environment variable XIL_PAR_ENABLE_LEGALIZER to 1 and try
   again
ERROR:Pack:1654 - The timing-driven placement phase encountered an error.

相关帖子

沙发
AutoESL| | 2011-9-6 10:55 | 只看该作者
这写的很清楚啊,FPGA的资源不够了
This design does not fit into the number of slices available in this device due to the complexity of  the design and/or constraints.

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板凳
avonhu| | 2011-9-6 11:30 | 只看该作者
1# iampeter
错误提示非常清楚,所采用的FPGA芯片资源不足以实现你的设计。
1、简化或优化你的设计;
2、选用适合你设计规模的FPGA芯片。

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地板
jakfens| | 2011-9-6 13:06 | 只看该作者
从以上两楼的评论来看 是不是可以认为lz的芯片slice太少了?所设计的东西所要求的slice比芯片还多?

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5
amini| | 2011-9-7 08:43 | 只看该作者
要学的东西太多了。:Q

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6
iampeter|  楼主 | 2011-9-7 20:39 | 只看该作者
把chipscope的CDC文件删除了就可以了,估计是那就够资源了吧!!!

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7
zidingl| | 2011-11-3 16:54 | 只看该作者
是否给某个宏单元块的区域约束太小,超过了元器件所包含的slice
例如
INST "rx0" RLOC_ORIGIN=X20Y60;
检查y60是否过大

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8
zidingl| | 2011-11-3 16:55 | 只看该作者

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9
GoldSunMonkey| | 2011-11-3 17:17 | 只看该作者
:L多久的帖子了

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10
fu10| | 2011-11-3 23:54 | 只看该作者
呵呵......喜欢翻旧贴呢;P

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11
tikelu| | 2011-11-4 07:08 | 只看该作者
感觉稍微的老了一点点

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12
tikelu| | 2011-11-4 07:08 | 只看该作者
:lol

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