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如何编程设计三级流水线，计算样本方差 attach_img
编程 ，AC ，C语言 ，verilog ，编写
电子技术交流论坛 TDJC 2019-5-6 0 634 TDJC 2019-5-6 17:56
用Verilog或VHDL写一段代码,实现消除一个glitch？
verilog ，VHDL ，代码 ，tc
新手园地 一片混沌 2018-9-11 0 184 一片混沌 2018-9-11 12:02
Verilog HDL的基础知识详细概述 attachment
HDL ，基础知识 ，verilog ，仿真 ，EDA
EDA 技术 gaochy1126 2021-2-28 0 764 gaochy1126 2021-2-28 09:51
Verilog HDL和VHDL的区别
HDL ，VHDL ，hd ，verilo ，verilog
EDA 技术 gaochy1126 2023-1-31 0 1690 gaochy1126 2023-1-31 21:03
关于Verilog中begin···end语句执行顺序
时序逻辑 ，时序 ，阻塞赋值 ，阻塞 ，顺序 ，verilog
EDA 技术 gaochy1126 2023-2-18 0 2545 gaochy1126 2023-2-18 15:45
Verilog HDL中位运算符、逻辑运算符和缩减运算符的区别
HDL ，hd ，verilo ，verilog ，位运算
EDA 技术 gaochy1126 2023-11-30 0 11536 gaochy1126 2023-11-30 20:50
Verilog学习经验分享
电路 ，经验分享 ，学习 ，verilog ，verilo
EDA 技术 gaochy1126 2024-9-28 0 6811 gaochy1126 2024-9-28 16:00
非阻塞赋值
阻塞 ，阻塞赋值 ，verilo ，verilog
EDA 技术 gaochy1126 2024-11-30 0 4759 gaochy1126 2024-11-30 21:30
verilog HDL ，太离谱了
verilog ，HDL ，FIR ，ADDR ，address
EDA 技术 binphy 2007-8-26 0 2104 binphy 2007-8-26 20:11
各位大师，请问怎么把verilog网表转成schematic?
schematic ，verilog ，verilo ，TI ，ic
EDA 技术 alexandery 2008-1-31 0 4259 alexandery 2008-1-31 10:53
[转]解决初学者疑惑：VHDL、Verilog，System+verilog比较
System ，verilog ，VHDL ，VerilogHDL ，FPGA
EDA 技术 FPGAA 2009-3-16 0 3561 FPGAA 2009-3-16 15:27
找上海兼职的IC 版图设计工程师
工程师 ，ic ，layout ，verilog ，仿真
创业|外包|承接 nickbird 2009-2-11 0 2488 nickbird 2009-2-11 16:43
Verilog讨论组精彩内容摘录
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FPGA论坛 星星之火红 2012-10-17 0 1237 星星之火红 2012-10-17 12:58
verilog 不可综合语
verilog ，se ，TI ，ge ，阻塞
FPGA论坛 GoldSunMonkey 2013-5-10 0 2056 GoldSunMonkey 2013-5-10 00:10
FPGA用IIC读写器件
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FPGA论坛 3008202060 2014-7-5 0 980 3008202060 2014-7-5 10:25
Xilinx FPGA入门连载9：Verilog语法检查 attach_img
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FPGA论坛 rousong1989 2015-9-23 0 879 rousong1989 2015-9-23 11:44
TI 的TMS320C54X的DSP的芯片软核verilog源代码 attachment
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德州仪器MCU xyz549040622 2015-12-4 0 689 xyz549040622 2015-12-4 17:10
下面的NCverilog tcl脚本内容求大神帮忙解释一下
tcl ，verilog ，脚本 ，TE ，SIM
FPGA论坛 t851018986 2016-11-24 0 1358 t851018986 2016-11-24 11:55
潘文明至简设计法系列教程-Verilog快速掌握新版简介
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FPGA:怎样实现时钟由30M向25M的转换
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