授之以渔： 卡尔曼滤波器 ....大泻蜜 .........................
2021-7-14 10:11
- 侃单片机论坛
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楼主真好，比网上全讲理论推导的强一百倍都不止
非常感谢楼主的无私奉献 ...
FPGA时序分析（二）
2013-2-21 21:53
- FPGA论坛
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4# viatuzi
谢谢楼主～我之前都还不知道CDC是什么呢。。。
产生毛刺怎么办
2012-10-10 10:45
- FPGA论坛
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14# aikimi7
TCO就是指从时钟上升沿开始，到数据到达管脚的时间
具体设多少跟你接的外设的TSU要求有关
你 ...
杯具的工作历史，事情不好散发，求安慰。。
2012-5-1 11:23
- 情感婚姻研习社
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- 4443
有好机会就跳吧
我10年毕业的，也是去年这个时候跳的
待遇虽然也不怎么样，但是能学到很多东西 ...
我其实就是要一个硬件工程师来做FPGA开发，却。。。。
2012-7-31 08:53
- FPGA论坛
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你是想要一个搞硬件的会设计外围电路原理图，会高速信号PCB布局布线，同时又能搞定FPGA代码编写仿真调试的 ...
AD采样数据同步问题
2012-12-6 21:29
- FPGA论坛
- 35
- 8971
你这样全部一起约束成一样的，估计没什么用
你是第11位跑的慢，其他的跑的快，你就约束第11位，让他跑快点
...
这样算不算流水线呢？
2012-3-29 18:35
- FPGA论坛
- 6
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推荐你看一下《VLSI数字信号处理系统设计与实现》这本书
你就明白了
FPGA时序分析（三）
2013-2-22 14:00
- FPGA论坛
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- 2704
楼主讲的非常好！都是非常本质的东西
楼主要是早一年写这个，我就可以省不少时间了 ...
能这样用while语句吗？
2012-4-8 17:32
- FPGA论坛
- 7
- 3527
别当程序写
CPLD和FPGA 是不是很难被**？
2012-4-21 22:52
- FPGA论坛
- 23
- 9597
这种代码看到就头晕
程序跑飞？
2012-9-9 16:28
- FPGA论坛
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- 5684
11# michelle123
我是让你自己去看啊。。。
我哪知道你哪些路径干什么的，我看了也没用啊
从我的经验来 ...
看看时序分析报告
如何让输出信号延时输出
2012-4-24 11:01
- FPGA论坛
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- 3360
用锁相环设定不同相移就行了
有偿求助 高速采样率 方案
2012-4-22 22:20
- FPGA论坛
- 12
- 2951
100MHZ以上的AD多的是，关键是需要经过什么样的处理后上传
上传数据量多大，要用什么接口上传 ...
新手的
2012-4-16 18:00
- FPGA论坛
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- 2636
先别急着下程序
还是先弄清楚什么是FPGA
工作原理是什么先吧
同步时钟
2013-4-27 11:10
- FPGA论坛
- 14
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学了不用，肯定会忘记啊
请教一下大家都是怎么进行FPGA设计的？？
2012-10-8 21:37
- FPGA论坛
- 22
- 4208
当模块比较多，而且相互间连接信号很多的时候，你就会发现图形输入有多麻烦了
而且我不觉得用图形会比用VHD ...
FPGA工程师面试试题
2012-8-24 17:12
- FPGA论坛
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很多不会
想学习FPGA，请推荐学习思路
2012-7-29 15:25
- FPGA论坛
- 14
- 3084
建议用VHDL，这样更容易让你认识到你编的只是一种描述代码，不是程序
如果用Verilog你在开始时可能会当成C ...
如何知道FIFO中当前存有一个数据
2014-3-20 08:47
- FPGA论坛
- 7
- 3789
有一个usedw信号可以用来指示FIFO中的数据个数
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