弱弱的问一下，用FPGA能否搭建一个并行的BP神经网络？
2013-7-5 16:29
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能给一个神经元的完整公式我吗？
神经元的互联方式也给出最好，是各自独立运行还是串并互联运行？
我编译下 ...
我觉得你可以先在matlab 上用DSP builder 先实现，并仿真，然后评估下资源和速度是否能达到你的要求 ...
定点数的乘法器和加法跑到100M没问题，传递函数可能你需要转换一下，这么直接的算的话速度肯定很慢的
可以 ...
全部都要求一定要用浮点数吗？32位的定点数精度是否能达到要求？
考研战985落败，是二战还是读二本普通研，还是努力工作？
2013-6-14 14:19
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读研吧
100颗FPGA的板子，开开眼界
2013-6-11 17:40
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太霸气了，跪了
求助NOIS初学问题，谢谢
2013-6-25 12:09
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WIN7兼容性的问题，你改用12.1版本的软件就好了
1个时钟驱动整片FPGA，有哪些方法提高速率？
2013-6-25 22:57
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好像是走线延迟比较长，可以试下按模块锁定逻辑块约束
这个路径是不是DSP块到寄存器的路径？ ...
RMB求购代码
2013-6-28 21:38
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能给出公式吗？
做嵌入式硬件设计最好考哪些证书？
2013-7-5 02:41
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把电路分析和模拟电路学好比什么证都强
FPGA项目外包，高手请进
2013-11-25 16:21
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我觉得是需求方面提的有点问题，要实现比较困难
也许根本不需要达到这些指标就能实现需要的功能 ...
谁用altera，来试试下面的代码
2013-8-26 13:28
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组合逻辑有点长了，看看是否能优化下吧
V7不应该这么慢吧？用的是低速等级的芯片？
Stratix4系列C2级别的能跑175M，关键路径是D_D1到dout_a的路径，最慢的一条需要5.673ns
Arria II 系列C4级 ...
项目外包
2013-7-26 23:19
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我们目前用的就是软核，想要什么自己加，方便的很
一般就是控制让软核做，高速接口和运算用硬件逻辑做， ...
一块开发板搞定，STM32可以用FPGA内的软核代替
只是想通过STM32动态配置FPGA吧
Verilog编写的控制模块,有时候正常工作,有时无**常工作
2013-8-1 19:52
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时序约束不完整
大家觉得没做过FPGA板子的实验，可以找到FPGA的工作么？
2013-8-7 15:10
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可以，只是相对有点难
先找家小公司入门吧
FPGA的普通I/O口用作时钟输入输出
2013-8-13 10:06
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如果不是很多寄存器要用到这个时钟的话是没什么问题的
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