晒晒新做的CYCLONE IV核心板 EP4CE15 共享原理图和测试程序
2025-8-3 23:55
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欣赏~~
FPGA实现HDLC协议
2017-4-6 12:23
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有代码吗？可否发一份给参考一下。
fifo最后一个数据读不出来
2014-4-21 10:49
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我以前也有这个问题，仿真一直不真确。但是实际使用的时候确实真确的，应该是仿真做的不好 ...
关于fpga里面的ram读写
2014-3-6 14:20
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恩恩，自己摸索出来了，谢谢楼上的
18个手把手教你FPGA的入门实验（PDF+代码）
2018-10-14 11:38
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为啥有的资料只有一个空文件夹？亲
FPGA和单片机的串行通信接口设计
2014-8-1 01:17
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哦哦，我是用的vdhl写的，嘿嘿
多字节?我有一个是用fifo的串口程序
reg型数组的初始化配置问题
2014-4-4 17:53
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不对。
altera uart核的问题
2020-8-24 13:22
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这个我做过。不知道楼主的意思是啥，你指的寄存器是什么？
FPGA与激光扫描仪网口通信
2014-4-14 09:50
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quartusII
如何动态配置Actel的FPGA管脚的上下拉？
2015-5-11 19:50
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这个是边以前在软件里面设置的，不能通过程序设定。
关于verilog状态机
2014-7-9 19:08
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什么？上代码
PC FPGA以太网通信
2014-7-10 17:29
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是不是抓包的时候网卡选择错了？
关于dsp和fpga之间spi通信的问题
2014-7-10 16:42
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只能告诉，去看时序图。懂得spi是怎么接受数据的。
能看懂时序图，fpga会操控输入输出引脚就可以搞定了，不难。关于fpga的例程论坛上有，不知道你用的是Verilo ...
看spi的时序图。fpga以前用过吗？
pickit3烧写12F609出现错误
2014-10-28 16:36
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嘿嘿，帮你在换一个
altera的FPGA的pll 模块不能正常工作，求解
2015-7-31 19:38
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解决了吗？地信号检查了吗
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